I 编码器时序
II 电路设计
III 程序设计
IV 仿真
- 1testbench
- 2波形

I 编码器时序

A的上升沿时候如果B为低电平，则旋转编码器向右转。
A的下降沿B为高电平，则一次右转结束。
A上升沿时候如果B为高电平，则旋转编码器向左转
A的下降沿B为低电平，则一次左转结束。

II 电路设计

III 程序设计

module abcode(clk, rst_n,A, //A相B, //B相testcnt
);input   clk,rst_n;
input   A,B;
output  reg [3:0] testcnt;//10ms计数器，用于消抖。
reg ok_10ms;
reg [31:0]cnt0;
always@(posedge clk,negedge rst_n)
beginif(!rst_n)begincnt0 <= 0;ok_10ms <= 1'b0;endelse beginif(cnt0 < 32'd49_9999)begin//10ms消抖 //我的编码器 此值设置为4999可用！！！！！！！！！！！！！cnt0 <= cnt0 + 1'b1;ok_10ms <= 1'b0;endelse begincnt0 <= 0;ok_10ms <= 1'b1;endend
end//同步/消抖 A、B
reg A_reg,A_reg0;
reg B_reg,B_reg0;
wire A_Debounce;
wire B_Debounce;
always@(posedge clk,negedge rst_n)beginif(!rst_n)beginA_reg <= 1'b1;A_reg0 <= 1'b1;B_reg <= 1'b1;B_reg0 <= 1'b1;endelse beginif(ok_10ms)beginA_reg <= A;A_reg0 <= A_reg;B_reg <= B;B_reg0 <= B_reg;endend
endassign A_Debounce = A_reg0 && A_reg && A;
assign B_Debounce = B_reg0 && B_reg && B;//对消抖后的A进行上升沿，下降沿检测。
reg A_Debounce_reg;
wire A_posedge,A_negedge;
always@(posedge clk,negedge rst_n)beginif(!rst_n)beginA_Debounce_reg <= 1'b1;endelse beginA_Debounce_reg <= A_Debounce;end
end
assign A_posedge = !A_Debounce_reg && A_Debounce;
assign A_negedge = A_Debounce_reg && !A_Debounce;//对AB相编码器的行为进行描述
reg rotary_right;
reg rotary_left;
always@(posedge clk,negedge rst_n)beginif(!rst_n)beginrotary_right <= 1'b1;rotary_left <= 1'b1;endelse begin//A的上升沿时候如果B为低电平，则旋转编码器向右转if(A_posedge && !B_Debounce)beginrotary_right <= 1'b1;end//A上升沿时候如果B为高电平，则旋转编码器向左转else if(A_posedge && B_Debounce)beginrotary_left <= 1'b1;end//A的下降沿B为高电平，则一次右转结束else if(A_negedge && B_Debounce)beginrotary_right <= 1'b0;end//A的下降沿B为低电平，则一次左转结束else if(A_negedge && !B_Debounce)beginrotary_left <= 1'b0;endend
end//通过上面的描述，可以发现，
//“rotary_right”为上升沿的时候标志着一次右转
//“rotary_left” 为上升沿的时候标志着一次左转
//以下代码是对其进行上升沿检测
reg rotary_right_reg,rotary_left_reg;
wire rotary_right_pos,rotary_left_pos;
always@(posedge clk,negedge rst_n)beginif(!rst_n)beginrotary_right_reg <= 1'b1;rotary_left_reg <= 1'b1;endelse beginrotary_right_reg <= rotary_right;rotary_left_reg <= rotary_left;end
endassign rotary_right_pos = !rotary_right_reg && rotary_right;
assign rotary_left_pos = !rotary_left_reg && rotary_left;//用于测试的计数器 右转+1 左转-1
always@(posedge clk,negedge rst_n)beginif(!rst_n)testcnt <= 4'd0;else if(rotary_right_pos)testcnt <= testcnt + 4'd1;else if(rotary_left_pos)testcnt <= testcnt - 4'd1;
endendmodule

IV 仿真

1testbench

`timescale 1ns/1ns
`define clk_period 20module tb;reg clk; reg rst_n;reg A; //A相reg B; //B相wire[3:0] testcnt;abcode f1(.clk(clk), .rst_n(rst_n),.A(A), //A相.B(B), //B相.testcnt(testcnt)
);initial clk = 1'd0;always #(`clk_period/2) clk = ~ clk;initial beginrst_n = 1'b0;A = 1;B = 1;#(`clk_period*20)rst_n = 1'b1;#(`clk_period)//模拟右转A = 1;B = 1 ;#250_000_00;A = 0;B = 1 ;#250_000_00;A = 0;B = 0 ;#250_000_00;A = 1;B = 0 ;#250_000_00;A = 1;B = 1 ;#250_000_00;A = 0;B = 1 ;#250_000_00;A = 0;B = 0 ;#250_000_00;A = 1;B = 0 ;#250_000_00;A = 1;B = 1 ;#250_000_00;A = 0;B = 1 ;#250_000_00;A = 0;B = 0 ;#250_000_00;A = 1;B = 0 ;#250_000_00;
//------------------------------------------            A = 1'bz;B = 1'bz;#50_000_00;//模拟左转         B = 1;A = 1 ;#250_000_00;B = 0;A = 1 ;#250_000_00;B = 0;A = 0 ;#250_000_00;B = 1;A = 0 ;#250_000_00;B = 1;A = 1 ;#250_000_00;B = 0;A = 1 ;#250_000_00;B = 0;A = 0 ;#250_000_00;B = 1;A = 0 ;#250_000_00;B = 1;A = 1 ;#250_000_00;B = 0;A = 1 ;#250_000_00;B = 0;A = 0 ;#250_000_00;B = 1;A = 0 ;#250_000_00;
//------------------------------------------ #2000;$stop;end endmodule

2波形

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