I2S原理分析(二十九)

在飞利浦公司的I2S标准中，既规定了硬件接口规范，也规定了数字音频数据的格式。
LRCK：左右声道采样率44.1k、48k..
BCLK: SCK,位时钟或串行时钟。若是2通道16bit，BCLK = 2 x 16 x 48KHz(采样率) = 1536KHz = 1.536MHz
MCLK:主时钟,有时为了使设备间能够更好地同步，还需要另外传输一个信号MCLK，称为主时钟,也叫系统时钟(Sys Clock), 通常是采样率LRCK的256, 384, 512倍.I2S有3个主要信号(3根线)：
1.串行时钟SCK，也叫位时钟（BCLK），即对应数字音频的每一位数据，SCLK都有1个脉冲。SCLK的频率=2×采样频率(LRCK = fs)×采样位数(16 or 24)2.字段(声道)选择WS，又称为LRCK，用于切换左右声道的数据。LRCK为“1”表示正在传输的是左声道的数据，
为“0”则表示正在传输的是右声道的数据。LRCK的频率等于采样频率(fs)。LRCK一个时钟周期采一个样点，
BCLK为64fs，即一时钟周期64位数据。3.串行数据SD(SDATA)，就是用二进制补码表示的音频数据。在飞利浦公司的I2S标准中，既规定了硬件接口规范，
也规定了数字音频数据的格式。有时为了使设备间能够更好地同步，还需要另外传输一个信号MCLK，
称为主时钟，也叫系统时钟（Sys Clock），是采样频率的256倍或384倍。Audio/sound音频部分涉及的几个频率:
audio sampling frequency缩写：fs* 输出采样频率 fs =

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