ICC2 CTS STEP

#第一步: Design Initialization for Clock Synthesis
1.说明cts 将工作在哪些scenario
2.cts 相关的app option
cts.common.max_fanout = 50
cts.common.max_net_length = 120
cts.common.user_instance_name_prefix = CTS
cts.compile.enable_cell_relocation = all
cts.compile.enable_global_route = true
cts.compile.enable_local_skew = false
cts.compile.fix_clock_tree_sinks = true
等等
3.cts时用到的buffer/Inverter ，一般用D4到D8的buffer inverter
4.cts时用到的ICG cell的list
5.指定哪一个corner 是clock tree building 过程中的主corner（CTS-103）
6.所有clock的sink，internal，root的NDR rule
7.clock cell的spacing rule

#第二步：Existing Clock Tree Removal
删除已经存在在的时钟树

#第三步：Clock Tree Initialization
1.检查时钟树结构，有问题的一些sink pin工具会设exception，放在当前目录下的clock_auto_exceptions*.tcl文件里。

2.以及工具自己的一些初始化，比如legalizer的初始化，extractor和timer的初始化等等，与user基本无关。

#第四步：Clock Cell Relocation
这里的clock cell指的时icg和mux，clock cell location会把icg放在所有sink的中间位置，以获得更好的qor，cts.compile.enable_cell_relocation这个app_option可以控制clock cell 如何 relocation，默认所有的clock cell都可以被relocation

#第五步：Gate-By-Gate Clock Tree Synthesis
按照 bottom up的方式长tree，依照设定好的max_transition和max_capacitance先长icg到sink的tree，再长icg到root的tree。
例如：

#第六步：Latency Bottleneck Analysis
这一步工具会把各个clock下超过500ps的latency的path报出来

#第七步：DRC Fixing Beyond Exception
修exception的sink点的drc 包括（trans,cap,fanout,netlength）
#第八步：Clock Net Global Routing
对时钟树做global route

#第九步：Pre-Optimization DRC Fixing
修 clock tree global route 后产生的drc 包括（trans,cap,fanout,netlength）
fix前后会统计当前scenario里每个clock group 的latency skew DRCviols，例如
fix 手段包括resize cell/relocation cell/clone repeater/insert buffer inverters

#第十步：Skew Latency Optimization and Area Recovery
主要进行clock tree 的 optimizing，包括对skew 和lantency进行优化同时进行Area Recovery 以便得到更好得QoR。同上一步一样，会在开头和结尾产生一个summary，例如
从图中可以看出来skew lantency 以及Area 优化的代价是又有一部分drc冒了出来。

#第十一步：Post-Optimization DRC Fixing
对clock tree skew 和lantency进行opt以及area recovery后又会冒少量的drc,这些drc会在这一步修掉，同上一步一样，会在开头和结尾产生一个summary。

#第十二步：Postlude
对clock cell进行legalize

#第十三步：summary report
报timing 产生summary report

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