三种方法用Verilog实现多人表决器

module biaojue(
a,b,c,d,e,f);
input a,b,c,d,e;
output f;
reg f;
reg[2:0] count1;
initial count1=0;
always@(a,b,c,d,e)
begin
count1=a+b+c+d+e;
f=count1<3?0:1;//当人数在三人以下是输出1
end
endmodule

module biaojue5(
input a,b,c,d,e,
output f
);
assign f=a&b&c||a&b&d||a&b&e||a&c&d||a&c&e||
a&d&e||b&c&d||b&c&e||b&d&e||c&d&e;//直接进行逻辑运算
endmodule

module biaojue(a,out);
input [5:0]a;
output reg [1:0]out;
integer i,count1,count2;
always@(*)begincount1=0;count2=0;i=0;while(i<4)beginif(a[i])count1=count1+1;//决定通过的人数elsecount2=count2+1;//表决不通过的人数i=i+1;endif(count1==count2)out=2'b00;else if(count1<count2)out=2'b00;else if(count1>count2)out=2'b01;//或者用if一步实现end
endmodule

三种表决器的实现方法。

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