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分为两种IP core ： UNIPHY 和ALTMEMPHY

比较 UNIPHY 性能更好一点不支持cyclone系列芯片，，ALTEMPHY 支持所有altera支持DDR2的芯片

其实两种IP 使用方法相同

http://www.altera.com.cn/literature/hb/external-memory/emi_rldram_ii_ug.pdf

uniphy：IP核设置步骤：

Memory clock frequency：给DDR的时钟频率

1、对FPGA PHY设置

PLL reference clock frequency：FPGA时钟引脚输入的时钟，供DDR的PLL使用时钟频率（关键设置）

Full or half rate on Avalon-MM interface： FULL---verilog逻辑部分数据位宽X2，速度/2，，达到了降频的目的（关键设置）

Additional address/command clock phase：是否允许地址、控制信号有相位的移动（一般要设置，否则时钟采样有问题）

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