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Design Compiler的作用是将RTL级代码转化为门级网表，为后续的时序分析和后仿做准备，其过程主要包括translation、optimization和mapping。DC的实现有两种方式，一种是命令行或脚本的方式，另外一种是图形界面方式。

DC综合需要库的支持，一般我们使用的库为.db的二进制文件。

库分为三个等级：target library、link library和symbol library。target library是指RTL级的HDL描述到门级时所需的标准单元综合库，它是由芯片制造商（Foundry）提供的，包含了物理信息的单元模型。link library可以是同target_library一样的单元库，也可以是已经底层已经被综合到门级的模块，在由下而上的综合过程中，上一层的设计调用底层已综合模块时，将从link_library中寻找并链接起来。symbol library是显示电路时，用于标识器件、单元的库。芯片供应商提供的库通常有max,type,min三种类型，代表操作环境为最坏(worst)，典型(type)，最好(best)三种情况，当然也有其他形式的库如fast.db、slow.db等。

DC综合中还要进行静态时序分析，这一点在很多教程中都有讲解，就不在赘述。需要记得的就是在DC中需要进行时序约束，与在其他软件.sdc中

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