驱动——K7-DMA-PCIe
在做Windows系统PCIe驱动时,遇到的一些硬件驱动有关的问题总结一下:
一、K7
K7处理器:信号采集卡
K7系列CPU是AMD公司推出的高性价比CPU。
结构
3个并行的X86指令解码器;9个为高频率优化的超标量微结构;动态推测时序,乱序执行; 2048个入口分支预测表和12个入口返回堆栈;3个超标量乱序整数管道,每个包含: 整数执行单元,地址产生单元;3个超标量乱序多媒体管道;64K指令一级CACHE和64K数据一级cache,每两路相关;2个通用64位数据cache装载/存储端口;高速64位后方2级CACHE控制器:支持512K到8MB二级cache,可编程接口速度;高速64位系统接口:200MHz系统总线。
AMD的K7处理器并没有采用和Intel的GTL+相同的系统总线协议,它使用的是Digital公司的Alpha系统总线协议EV6。顺便说一下,Alpha处理器是一种用于服务器系统的纯64位处理器,其性能优于现在用于PC系统的处理器。K7使用的EV6系统总线有许多的优点,首先,它有许多比GTL+更为优秀的构造,例如它使用点对点布局。其次它可以支持200MHz的外频,我们见到的K7是工作在200MHz的外频下的,K7 CPU成为第一个从高带宽内存如Direct RDRAM和DDR SDRAM中受益的CPU。
AMD在1999年底推出内建L2 Cache的“Sharptooth利齿”(K6-3)处理器,,K7内置的tag RAM足以支持和Intel的PentiumⅡ处理器一样的512KB的L2 Cache,同时AMD还考虑生产像Intel的P6 CPU一样的外置的tag RAM,来支持不少于2MB—8MB的具有64位可编程控制的后置L2 Cache。虽然K7将不会把L2 Cache内建在处理器里,但是L2 Cache的速度将占CPU主频的1/3至全速,并且L2 Cache将使用SRAM或者DDR SRAM以保证其速度。K7拥有128KB的L1 Cache,其中,64KB将作为数据缓存,剩下的64KB将作为指令缓存。
二、DMA
优点: 控制简单,它适用于数据传输率很高的设备进行成组传送。
当I/O设备没有DMA请求时,CPU按程序要求访问内存;一旦I/O设备有DMA请求,则由I/O设备挪用一个或几个内存周期。
(1)此时CPU不需要访内,如CPU正在执行乘法指令。由于乘法指令执行时间较长,此时I/O访内与CPU访内没有冲突,即I/O设备挪用一二个内存周期对CPU执行程序没有任何影响。
如果CPU的工作周期比内存存取周期长很多,此时采用交替访内的方法可以使DMA传送和CPU同时发挥最高的效率。
此图是DMA与CPU交替访内的详细时间图.假设CPU工作周期为1.2us,内存存取周期小于0.6us,那么一个CPU周期可分为C1和C2两个分周期,其中C1专供DMA控制器访内,C2专供CPU访内。
三、PCIe
PCI-Express(peripheral component interconnect express)是一种高速串行计算机扩展总线标准。
由于后者的固有限制,包括半双工操作,超量信号计数以及由于定时偏移引起的固有的较低带宽,因此,传统的并行总线选择了绑定串行总线架构。定时偏移来自在不同长度的导线,潜在不同的印刷电路板(PCB)层和可能不同的信号速度下行进的并行接口内的分离的电信号。尽管作为单个字同时传输,并行接口上的信号具有不同的行进持续时间,并在不同时间到达其目的地。当接口时钟周期短于信号到达之间的最大时间差时,就不可能恢复传输的字。由于并行总线上的定时偏移量可能达到几纳秒,因此所产生的带宽限制在几百兆赫的范围内。
串行接口不会出现定时偏移,因为每个通道中每个方向只有一个差分信号,并且由于时钟信息嵌入在串行信号本身中,所以没有外部时钟信号。因此,串行信号的典型带宽限制在几千兆赫范围内。 PCI Express是串行互连替代并行总线的一般趋势的一个例子;其他示例包括Serial ATA(SATA),USB,Serial Attached SCSI(SAS),FireWire(IEEE 1394)和RapidIO。在数字视频中,常用的例子有DVI,HDMI和DisplayPort。
多通道串行设计增加了灵活性,其能够为较慢的设备分配较少的通道。
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