DDR5 trainning

1. read train

2. read preamble train

3. ca train

4. cs train

5. write leveling

1）extern write leveling train：

2）internal cycle alignment ：

host通过dq返回的dqs对Internal Write Leveling Pulse的采样结果，来调整dqs_t/c的delay，使其满足CWL并且与ck沿对齐，同时minimizet DQSOffset

...待续

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