计算机组成原理下列数中最小的数位,计算机组成原理试题(四)
一.选择题(每空1分,共20分)
1. 将有关数据加以分类、统计、分析,以取得有利用价值的信息,我们称其为______。
A. 数值计算 B. 辅助设计 C. 数据处理 D. 实时控制
2. 目前的计算机,从原理上讲______。
A.指令以二进制形式存放,数据以十进制形式存放
B.指令以十进制形式存放,数据以二进制形式存放
C.指令和数据都以二进制形式存放
D.指令和数据都以十进制形式存放
3. 根据国标规定,每个汉字在计算机内占用______存储。
A.一个字节 B.二个字节 C.三个字节 D.四个字节
4. 下列数中最小的数为______。
A.(101001)2 B.(52)8 C.(2B)16 D.(44)10
5. 存储器是计算机系统的记忆设备,主要用于______。
A.存放程序 B.存放软件 C.存放微程序 D.存放程序和数据
6. 设X= —0.1011,则[X]补为______。
A.1.1011 B.1.0100 C.1.0101 D.1.1001
7. 下列数中最大的数是______。
A.(10010101)2 B.(227)8 C.(96)16 D.(143)10
8. 计算机问世至今,新型机器不断推陈出新,不管怎样更新,依然保有“存储程序”的概念,最早提出这种概念的是______。
A.巴贝奇 B.冯. 诺依曼 C.帕斯卡 D.贝尔
9. 在CPU中,跟踪后继指令地指的寄存器是______。
A.指令寄存器 B.程序计数器 C.地址寄存器 D.状态条件寄存器
10. Pentium-3是一种______。
A.64位处理器 B.16位处理器 C.准16位处理器 D.32位处理器
11. 三种集中式总线控制中,______方式对电路故障最敏感。
A.链式查询 B.计数器定时查询 C.独立请求
12. 外存储器与内存储器相比,外存储器______。
A.速度快,容量大,成本高 B.速度慢,容量大,成本低
C.速度快,容量小,成本高 D.速度慢,容量大,成本高
13. 一个256K×8的存储器,其地址线和数据线总和为______。
A.16 B.18 C.26 D.20
14. 堆栈寻址方式中,设A为累加器,SP为堆栈指示器,MSP为SP指示的栈顶单元。如果进栈操作的动作顺序是(A)→MSP,(SP)-1→SP。那么出栈操作的动作顺序应为______。
A.(MSP)→A,(SP)+1→SP B.(SP)+1→SP,(MSP)→A
C.(SP-1)→SP,(MSP)→A D.(MSP)→A, (SP)-1→SP
15. 当采用______对设备进行编址情况下,不需要专门的I/O指令组。
A.统一编址法 B.单独编址法 C.两者都是 D.两者都不是
16. 下面有关“中断”的叙述,______是不正确的。
一旦有中断请求出现,CPU立即停止当前指令的执行,转而去受理中断请求
CPU响应中断时暂停运行当前程序,自动转移到中断服务程序
中断方式一般适用于随机出现的服务
为了保证中断服务程序执行完毕以后,能正确返回到被中断的断点继续执行程序,必须进行现场保存操作
17.下面叙述中,______是正确的。
A.总线一定要和接口相连 B.接口一定要和总线相连
C.通道可以替代接口 D.总线始终由CPU控制和管理
18.在下述指令中,I为间接寻址,______指令包含的CPU周期数最多。
A.CLA B.ADD 30 C.STA I 31 D.JMP 21
19.设寄存器位数为8位,机器数采用补码形式(含一位符号位)。对应于十进制数-27,
寄存器内为______。
A.27H B.9BH C.E5H D.5AH
20.某存储器芯片的存储容量为8K×12位,则它的地址线为____。
A.11 B.12 C.13 D.14
二. 填空题(每空1分,共20分)
计算机软件一般分为两大类:一类叫A.______,另一类叫B.______。操作系统属于 C.______ 类。
一位十进制数,用BCD码表示需A.______位二进制码 ,用ASCII码表示需B.______位二进制码。
主存储器容量通常以KB表示,其中K=A.______;硬盘容量通常以GB表示,其中G=B.______。
RISC的中文含义是A.______,CISC的中文含义是B.______。
主存储器的性能指标主要是存储容量、A.______、B.______和C.______。
由于存储器芯片的容量有限,所以往往需要在A.______和B.______两方面进行扩充才能满足实际需求。
指令寻址的基本方式有两种,A.______方式和B.______方式。
存储器和CPU连接时,要完成A.______的连接;B.______的连接和C.______的连接,方能正常工作。
操作控制器的功能是根据指令操作码和A.______,产生各种操作控制信号,从而完成B.______和执行指令的控制。
三. 简答题(每题5分,共20分)
指令和数据均存放在内存中,计算机如何从时间和空间上区分它们是指令还是数据。
什么是指令周期?什么是机器周期?什么是时钟周期?三者之间的关系如何?
简要描述外设进行DMA操作的过程及DMA方式的主要优点。
在寄存器—寄存器型,寄存器—存储器型和存储器—存储器型三类指令中,哪类指令的执行时间最长?哪类指令的执行时间最短?为什么?
四.应用题(每题5分,共40分)
1.求十进制数-113的原码表示,反码表示,补码表示和移码表示(用8位二进制表示,并设最高位为符号位,真值为7位)。
2.某机指令格式如图所示:
OPXD
15 10 9 8 7 0
图中X为寻址特征位,且X=0时,不变址;X=1时,用变址寄存器X1进行变址;X=2时,用变址寄存器X2进行变址;X=3时,相对寻址。设(PC)=1234H,(X1)=0037H,
(X2)=1122H,请确定下列指令的有效地址(均用十六进制表示,H表示十六进制)
(1)4420H (2)2244H (3)1322H (4)3521H (5)6723H
3.将十进制数354
转换成二进制数、八进制数、十六进制数和BCD数。
4.浮点数格式如下:1位阶符,6位阶码,1位数符,8位尾数,请写出浮点数所能表示的范围(只考虑正数值)。
5.现有一64K×2位的存储器芯片,欲设计具有同样存储容量的存储器,应如何安排地址线和数据线引脚的数目,使两者之和最小。并说明有几种解答。
6.异步通信方式传送ASCII码,数据位8位,奇校验1位,停止位1位。计算当波特率为4800时,字符传送的速率是多少?每个数据位的时间长度是多少?数据位的传送速率是多少?
7.已知某8位机的主存采用半导体存储器,地址码为18位,采用4K×4位的SRAM芯片组成该机所允许的最大主存空间,并选用模块条形式,问:
(1)若每个模块条为32K×8位,共需几个模块条?
(2)每个模块条内有多少片RAM芯片?
(3)主存共需多少RAM芯片?CPU需使用几根地址线来选择各模块?使用何种译码器?
8.画出中断处理过程流程图。
计算机组成原理试题(四)答案
一.选择题:
1.C 2.C 3.B 4.A 5.D 6.C 7.B
8.B 9.B 10.A 11.A 12.B 13.C 14.B
15.A 16.A 17.B 18.C 19.C 20C
二. 填空题:
A.系统软件 B.应用软件 C.系统软件
2. A.4 B.7
3. A.210 B.230
4.A.精简指令系统计算机 B.复杂指令系统计算机
5.A.存取时间 B.存储周期 C.存储器带宽
6.A.字向 B.位向
7.A.顺序寻址方式 B.跳跃寻址方式
8.A.地址线 B.数据线 C.控制线
9.A.时序信号 B.取指令
三. 简答题:
时间上讲,取指令事件发生在“取指周期”,取数据事件发生在“执行周期”。从空间上讲,从内存读出的指令流流向控制器(指令寄存器)。从内存读出的数据流流向运算器(通用寄存器)。
指令周期是完成一条指令所需的时间。包括取指令、分析指令和执行指令所需的全部时间。机器周期也称为CPU周期,是指被确定为指令执行过程中的归一化基准时间,通常等于取指时间(或访存时间)。时钟周期是时钟频率的倒数,也可称为节拍脉冲或T周期,是处理操作的最基本单位。一个指令周期由若干个机器周期组成,每个机器周期又由若干个时钟周期组成。
(1)外设发出DMA请求;
(2)CPU响应请求,DMA控制器从CPU接管总线的控制;
(3)由DMA控制器执行数据传送操作;
(4)向CPU报告DMA操作结束。
主要优点是数据数据速度快
寄存器-寄存器型执行速度最快,存储器-存储器型执行速度最慢。因为前者操作数在寄存器中,后者操作数在存储器中,而访问一次存储器所需的时间一般比访问一次寄存器所需时间长。
四.应用题
1. 原码 11110001
反码 10001110
补码 10001111
移码 00001111
2.(1)0020H (2)1166H (3)1256H (4)0058H (5)1257H
3.(1)(354
)10=(162.A)16
(2)(354
)10=(101100010.1010)2
(3)(354
)10=(542.5)8
(4)(354
)10=(001101010100.011000100101)BCD
4. 最小值2^-111111×0.00000001
最大值2^111111×0.11111111
设地址线x根,数据线y根,则
2^x·y=64K×2
若 y=1 x=17
y=2 x=16
y=4 x=15
y=8 x=14
因此,当数据线为1或2时,引脚之和为18
共有2种解答
每个字符格式包含十个位,因此字符传送速率
4800波特/10=480字符/秒
每个数据位时间长度T=1/4800=0.208ms
数据位传送速率8×480=3840位/秒
(2^18×8)/(32k×8)=8,故需8个模块
(32k×8)/(4k×4)=16,故需16片芯片
共需8×16=128片芯片
为了选择各模块,需使用3:8译码器
即3根地址线选择模条。
8.中断处理过程流程图如图C2.1所示。
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