理解DC中的link_library与target_library
下图是DC的工作流程示意图：
Translate
当DC把我们的rtl代码读入后，会自动地将代码Translate成GTECH的网表，GTECH是synopsys自家开发的一种通用的，独立于工艺的标准库，里面有与门、非门、寄存器等各种基本单元。下图即为代码读入后由DC产生的GTECH网表，此时GTECH网表仍然保持和rtl代码的相同的层次结构。
查看单个逻辑单元的属性，可以看到确实使用的是GTECH的库。
Link
第一张图中省略了link的步骤，link是介于Translate和Compile之间的一个小的步骤，主要目的在于解决设计中所有的reference。换句话说，你设计中的所有instances必须要找到它们自己的定义。这些instances可以分为三类：已经Translate的GTECH网表、stdcell、macros（RAM、ROM、IP、etc）。
- 已经Translate的GTECH网表可以从内存中获取。
- 如果在你的rtl代码中手动例化了foundary厂家提供的stdcell，当然GTECH网表中就会存在这个讨人厌的stdcell。
- 对于macros，一般也是以.db的库提供的。
所以我们的link_library设置如下：
set_app_var link_library [list * ${target_library} macro_library1 macro_library2]*表示从内存中获取，对应Translate的GTECH网表；${target_library}对应stdcell；macro_library1、macro_library2对应macros。
Compile（=Optimize+Map）
DC的Compile步骤会将逻辑单元映射到foundary厂家提供的库单元上去。这里的库由target_library来指定。具体来说，DC在mapping的时候，会从target_library中挑选出功能一致的stdcell来替换当前网表中的逻辑单元。
set_app_var target_library [list smic13_ss.db]
可以看到，compile之后我们的逻辑单元都被替换成了target_library中的stdcell了。
Other
为了加深对link_library和target_library的理解，我们不妨再聊一聊。
Q1.如果我给DC的就是干净的rtl代码，没有stdcell和macro的例化，是不是link_library只设置为*就可以了？
A1.可以，甚至于你不设置link_library也只会出现warning而已，因为DC还是会忍不住去内存中瞅瞅看。
Q2.为啥经常看到别人的link_library中包含了target_library?
A2.其实上面已经解释过了，我们难免会去手动例化一些target_library中stdcell，此时我们不希望DC不认识我们例化的东西。另外一种说法是我们DC综合出来的网表，还可以继续让DC吃进去，如果link_library中不包含target_library，link时就找不到对应的stdcell定义了。
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