数字逻辑·时序线路设计【原始状态表】
这一篇着重原始状态表
组合线路设计与时序线路设计的区别
组合线路设计方法:
- 确定输入和输出
- 写真值表
- 写表达式并化简
- 根据题目给出的门或者其他要求进行变换(取反)
- 画电路图
时序线路设计方法:
- 确定输入和输出,建立原始状态表
- 化简并建立最简状态表
- 状态编码
- 建立控制、输出函数表达式
- 画电路图
例
确定输入和输出
建立原始状态表
这种方法普适性强,基本上题目都可以解
也可以是如下这种:
这种可能更需要仔细地推敲
化简并建立最简状态表
化了相同颜色线的行,在X=0,1情况下,变化状态都是相同的,所以这几行本质上是相同的,可以合并成一行(标定好状态符号qn)
如果发现还可以继续化简,那就继续化简
状态编码
编码有点像格雷码——两个状态相邻就将两个状态编成格雷码(只有一位不同)(s1和s2相邻就编成00和10)
确定输出及控制函数
约束条件为任意项(之前弄错过)
画逻辑电路图
练习
推荐右边的写法,更加明了易懂
作业
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