60进制计数器的设计
任务描述
本关任务:在第2关六进制计数器和第3关十进制计数器基础上,用级联的方法构建一个六十进制计数器,要求具有同步置数、异步清零功能。
相关知识
建议使用同步时序逻辑。 设计难点:使能信号逻辑和进位输出逻辑。 “骨肉相连”模型: 1)2n
进制计数器
T触发器可以看成是21
进制计数器,Q既是状态又是进位输出。 2)10n
进制计数器
3)整十进制、整百进制计数器,原理同上!
引脚说明
信号 | I/O | 位宽 | 说明 |
---|---|---|---|
D1,D0 | 输入 | 4 位 | 并行数据加载端 |
Reset | 输入 | 1 位 | 异步清零端:Reset=1时,Q=0 |
Clock | 输入 | 1 位 | 时钟脉冲,上升沿有效 |
Load | 输入 | 1 位 | 同步置数端:Reset=0、Load=1、Clock↑时,Q=D |
Enable | 输入 | 1 位 | 使能端:Reset=0时,Enable=1递增计数、0保持 |
Q1,Q0 | 输出 | 4 位 | 状态输出端:分别表示十位和个位 |
Co | 输出 | 1 位 | 进位输出端:状态Q1Q0=59时,Co=1 |
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