华为机试2021答案

1、 fwrite和fwrite和fwrite和fdisplay的区别，fwrite写下一个数不会自动转行，可以加来转行，fwrite写下一个数不会自动转行，可以加来转行，fwrite写下一个数不会自动转行，可以加来转行，fdisplay则会自动转行。
2、、

3、反转少，省功耗

4、
一个4位有符号二进制整数，它的补码能够表示的最大数是+7，最小数为什么是-8，而原码是-7到7，反码也是-7到7。
对于n位有符号数，补码数值表示范围为
[- 2n-1,2n-1-1]，而且[-8]补 = 1000 B，这是人为规定的。
当然原码四位二进制为0111—1111，最高位是符号位，所以是-7到7.同理，反马即是原码取反，自然也是-7到7.
5、
从某种意义而言，综合就是将设计的HDL描述转化为门级网表的过程。Synopsys公司提供的综合工具DC把综合分为三个步骤进
行：synthesis＝translation＋mapping＋optimization。Translation是指把设计的HDL描述转化为
GTECH库元件组成的逻辑电路；GTECH库是Synopsys公司提供的通用的、独立于工艺的元件库。Mapping是指将GTECH库元件映射到某
一特定的半导体工艺库上，此时的电路网表包含了相关的工艺参数。Optimization是根据设计者设定的时延、面积、线负载模型等综合约束条件对电路
网表进一步优化的过程。

6、c
7、case包含所有状态则不需要
对代码进行速度优化（提高时钟频率）
8、B
9、A
10、B
11、并发断言，不同

错误

12、控制器

由于运算器和控制器在逻辑关系和电路结构上联系十分紧密，通常将它们合起来统称为中央处理器，简称CPU,
13、B
14、状态机3个基本要素：状态、输入、输出
15、

冯诺依曼结构中程序计数器，其功能是存放当前欲执行指令的地址，并可自动计数形成下一条指令地址。
哈佛结构中程序和数据存储器在两个分开的物理空间中，因此取指和执行能完全重叠
16、错，genvar
17、是
18、%
19、D
20、对
2
位置关联法：实例化子模块时，按照子模块定义时端口出现的顺序建立端口的连接关系
名称关联法：实例化子模块时，直接通过名称建立子模块端口的连接关系，不考虑其排列顺序
22、A
SVA，System Verilog Assert
(6条消息) SVA——断言属性之序列（sequence与property的用法）_Mr.翟的博客-CSDN博客
23、
24、
功耗构成：
1、动态功耗
SoC的功耗可以分为动态功耗以及静态功耗。所谓动态态功耗即，器件处于开态是所消耗的功耗，一般发生在信号跳变时。静态功耗为器件接通电源，但是没有发生信号跳变时的功耗。在CMOS电路中，静态功耗一般为漏电流导致的。
动态功耗主要有：
1）信号跳变时对负载电容进行充放电产生的功耗；
2）电路内部的电容充电，以及在信号转换过程NMOS与PMOS同时打开时产生的功耗。用公式可以表示为：

降低动态功耗的方法主要有：
1）多电源技术（Multi-Voltage）；
2）门控时钟技术（Clock Gating）；
3）门级功耗优化。

2、静态功耗
静态功耗主要由漏电流产生，MOS器件的漏电流主要有衬底漏电流（ISUB),栅极漏源（Ig），栅极导致的漏源漏电流（Igd），pn节反偏漏电流（Ires）。
对于减小漏电流产生的静态功耗主要有以下的方法：
1）多阈值电压技术（Multi-VT）：在满足性能需求时，尽量使用高阈值电压；
2）门控电压（power gating）：在模块不工作时，将模块关闭；
3）可变阈值电压技术（Variable Threshold CMOS (VTCMOS)），采用背栅工艺，调节器件的阈值电压，以达到减小漏电流的目的；
4）self reverse bias(Stack Effect)
5)使用长沟道器件

25、赋值语句 - 百度文库 (baidu.com)
AD好像都不对
28、补码可以直接参与乘除
30、buf是关键字

多选1、
跨时钟域处理方法总结–最终详尽版 - love小酒窝 - 博客园 (cnblogs.com)
BC
多2、
BC
多3、ABCD
多4、ABC 在Verilog中最常用的编码方式有二进制编码(Binary)、格雷码(Gray-code)编码、独热码(One-hot)编码
多5、BD ASIC设计规范 - 道客巴巴 (doc88.com)
多6、

双握手法
MUX 单向同步，MUX同步器也就是无所谓时钟域的快慢问题了,
多7、ACD
多8、intial delays time不可综合
多9、 ABCD
1、 FPGA时钟频率只能到几百兆，ASIC可以到几GHz
2、 FPGA属于硬件电路，其断电失去数据，所以需要配备ROM。但其程序并不由任何执行单元顺序执行，其规定的是内在的电路结构，执行流程一般由状态机决定，且一般不止一个，即多线程。
ASIC为专用集成电路，其不可编程，相当于固化了的FPGA，但大量生产出片时，其价格比FPGA便宜的多。对于需要大量芯片且电路结构设计比较稳定的场合，出于成本考虑，可以使用ASIC。
3、 FPGA和ASIC的RAM工作模式——WRITE_FIRST / READ_FIRST / NO_CHANGE，

多10、ABCD

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