高速串行总线仿真(三)

1.从一个多层板工程中验证串行通道
2.在多层板中设置连接器模型

1.从一个多层板工程中验证串行通道

在本例练习中,将集中研究从芯片到插件形成的串行发射通道,并分析它的性能。
(1)打开 HyperLynx 软件,在软件主菜单单击“File”→ “Open MultiBoard project”
从以下路径打开 Entire_System.pjh 文件:C:\Adv_HL_Tmg \SERDES_Interface \postlayout \Multi-
Board,如图 所示。

(2)当打开设计遇到提示信息时,单击“No”按钮。
(3)选择网络“CHANNEL2_TX_TO_J2_P”,如图所示。

此时,一个IBIS模型已经分配好,接下来,将为主板上的缓冲器分配SPICE驱动模型。

(4)为U1.AT8/U1.AT9缓冲器分配 noDeE_trsnmtr.sp模型,如图所示。

①打开分配模型对话框。
②从设计文件的下拉列表中选择“B00 Motherboard”。
③选择U1.AT8。
④单击“Select”按钮。
⑤使能 SPICE 选项。
⑥选择“noDeE_trsnmtr.sp”模型。
⑦单击“OK”按钮。
⑧设置缓冲器为“Output”。
⑨在对话框中设置以下参数,如图所示。
pos_out:U1.AT8
neg_out:U1.AT9
stimulus: stimulus
neg_stimulus: Inverted Stimulus

(5)从下拉列表中设置以下参数,如图所示。

Approx Output Switching Time: 0.08ns
Stimulus V high: 1V
Stimulus V low: -1V
在 BoardSim 中,如果为一个串联电容分配 Spice 模型,电容两边的物理连接将不再是连接着的电气网络。因此,在仿真中必须去除串联电容的仿真,所以只能把电容的参考名称变为0ohms 电阻。
(6)设置参考名称C为一个电阻,如图所示。

① 选择“Setup” →“Options” →“Reference Designator Mappings”。
②在“Mappings”选项中选择“C = Capacitor”。
③使能“Resistor”选项。

④单击“Add/Apply”按钮。
⑤单击“OK”按钮。
⑥在提示重新下载设计的警告信息中单击“确定”按钮,如图所示。

(7)选择“File”→“Recent Files”→“Entire_System.pjh”,选择“Yes”按钮进行保存。在接下来的对话框中选择默认设置单击“OK”按钮,如图所示。

(8)再次选择CHANNEL2_TX_TO_J2_P,单击“COMP”按钮来确认串联电容被设置为电阻,值设置为0,如图所示

(9)打开示波器,启动 Eldo/Adms 和 Eye Diagram 选项。

(10)单击“Configure”按钮,设置以下参数。
Sequence:PRBS
Bit Order:7
Bit Interval: 0.4ns
Sequence Repetitions: 1
Skip First:10
Show:1eye

(11)启用差分探针U40_B03的 A30/A29引脚,设置如图所示。

(12)单击“Start Simulation”按钮,当仿真结束,启用 PCIE_RX 眼罩,调整到眼中间,由图可见,它能通过眼罩。


2.在多层板中设置连接器模型

在本节练习中,将设置仿真含有连接器S参数模型的串行通道。连接器的S参数模型是一个4端口模型,将把这个S参数模型分配到连接器,该连接器是连接选中的差分对网络的。在映射端口之前,需要找到确切的引脚编号,以便能够正确地连接连接器和差分对。

(1)打开“Assign Models”对话框,单击图标,如图所示

(2)在“Design”下拉列表中,确保“B00 Motherboard”被选中,如图所示。

(3)注意到J2连接器引脚名称如下:A21和 A22。接下来,找出将要分配模型的S参数连接。首先需要知道在创建端口时它是如何分配的(例如:端口1到端口2或者端口1到端口3)。
(4)在 HyperLynx 中,选择“Models”→“Edit Touchstone Models”,打开如图所示对话框。

(5)选择 “File”→ “Open Touchstone”,打开路径 C:\Adv_HL_Tmg\SERDES_Interface\models,选中connector.s4p,单击打开,如图所示。

(6)在“ Loaded files”窗格中,单击 connector.s4p 选择 View Connectivity,打开如图所示对话框,这表明端口1到端口3有一个很强的连接性。


(7)选择Port2,将看到它与端口4有很强的连接性,如图 所示。

根据上面所有的信息,你将分配连接器模型到差分对。
(8)关闭Touchstone Viewer,返回到多板工程。
(9)选择“Edit”→“MultiBoard Project”,打开如图所示对话框。

(10)单击两次“Next”按钮,得到如图所示界面。

(11)由上而下选择第二项,使能“Advanced”前面的选项,如图所示。

(12)单击“Assign”按钮,选择模型类型为“Touchstone models”,在库中选择“connector.s4p”,如图所示。

(13)在对话框中设置如表所示端口,如图所示。


留下端口3和端口4的Pin列为默认,可以允许接下来用图形化来映射这些端口。
(14)单击“OK”按钮,选中“connector.s4p”这一行,单击“Connection Editor”按钮,如图所示。

J2主板连接器被定义与A21和A22引脚连接,并被分配端口1和端口2,这是上面所做的工作。接下来将使用图形化的单击拖曳对端口进行J_PCIEXPI引脚分配,为端口3和端口4分配引脚。

(15)滚动鼠标知道A21和 A22与J_PCIEXPI 连接,单击拖曳引脚 A21向上移动直到与 Port3相连接,放开鼠标;重复以上操作,将 A22与 Por4相连接。连接完成的对话框如图所示。

(16) 单击“Close”按钮关闭对话框。单击“Finish”按钮。
(17)单击“Yes”按钮,确认重新打开设计。
(18)在保存的多板编辑对话框中,保留默认设置,单击“OK”按钮。
(19)在弹出的警告提示信息对话框中选择“否”。
(20)采用默认设置,单击“OK”按钮。
(21)打开工程后,再次选择网络为“CHANNEL2_TX_TO_J2_P”,如图所示。

(22)打开示波器,使能Eldo/ADMS选项。
(23)将U40_B03的A30引脚按照以下参数仿真一个眼图,仿真结果如图所示。

Sequence:PRBS
Bit Order:7
Bit Interval:0.4ns
Sequence Repetitions: 1
Skip First:10
Show:1eye

(24)测量眼宽和眼高,如图所示。


(25)将以上仿真结果进行比较,可见连接器模型对眼图有很大的影响

HyperLynx(三十一)高速串行总线仿真(三)相关推荐

  1. HyperLynx(三十)高速串行总线仿真(二)

    高速串行总线仿真(二) 仿真实例 1.探索多层板中的PCI-E串行通道 2.设置叠层以减小损耗 3.分析通道的不同配置对损耗的影响 4.检测驱动端规范 5.检查接收器规范 6.通过仿真得出整个通道的驱 ...

  2. HyperLynx(三十二)高速串行总线仿真(四)

    高速串行总线仿真(四) 在上节的基础上 1.通过导出到LineSim验证一个串行通道 2.快速眼图仿真 3.高速串行总线设计注意事项 1.通过导出到LineSim验证一个串行通道 接下来,将导出网络到 ...

  3. HyperLynx(二十九)高速串行总线仿真(一)

    高速串行总线仿真(一) 1.高速串行接口 2.SERDES(串行/解串器)架构 3.高速串行链路仿真拓扑结构 4.高速串行信号仿真流程 5.IBIS-AMI模型 6.高速串行信号仿真方法 随着电子产品 ...

  4. 高速串行总线设计基础(三)SERDES的通用结构介绍

    文章目录 前言 SERDES的基本构造 SERDES的通用框图 市场上的SERDES或Transceiver展示 Xilinx的Transceiver架构展示 Altera的SERDES介绍 往期回顾 ...

  5. 高速串行总线设计基础(五)揭秘SERDES高速面纱之多相数据提取电路与线路编码方案

    文章目录 前言 多相数据提取电路 线路编码方案 8B/10B编解码 运行差异(Running Disparity) 控制字符 Comma 检测 加扰技术 参考文献 前言 SERDES可以工作在多吉比特 ...

  6. 高速串行总线走线难点在哪?重要线信号的处理经验分享

    转自:电子发烧友网 串行总线的发展一共目前可以总结分为 3 个环节时期: 时钟并行总线:小于 200MHZ,比如CPCI,PCIX,SDRAM,ISA,PIC 源同步时钟并行总线:小于 3200Mbp ...

  7. 高速串行总线设计基础(八)揭秘SERDES高速面纱之CML电平标准与预加重技术

    文章目录 前言 物理信号 预加重 差分传输线 参考资料 前言 对于数字工程师来说,我们可能关注的仅仅是本文中的差分信号电平标准以及预加重技术,CML电平标准是Transceiver技术的首选,在Xil ...

  8. 高速串行总线设计基础(四)眼图的形成原理

    前言 眼图的形成原理 眼图的参数含义 眼图的模板 眼图的识别依据? 前言 眼图的测量对于高速串行总线的重要性不言而喻,眼图反映了总线通道环境的优劣,信号的好坏等等,正确的识别眼图是一项基础技能,如果具 ...

  9. 高速串行总线系列(2)高速串行总线技术总览

    文章目录 嵌入式高速串行总线技术应用对比 SRIO总线 JESD204总线 PCIE SATA总线 Aurora FC标准 VPX架构 嵌入式高速串行总线技术应用对比 SRIO总线 SRIO(Seri ...

最新文章

  1. markdown的流程图实现和代码语法着色
  2. 因为银行过度授信导致信用卡逾期还不上,可以拒绝还款吗?
  3. 计算机等级考试试题4,计算机等级考试二级模拟试题4
  4. JAVA——两个List集合求交集、并集和差集(去重)模板
  5. java中的文件处理io_Java的IO前奏曲:文件操作类之___File
  6. 【重难点】【Java基础 04】值传递和引用传递、序列化和反序列化
  7. AutoCAD2012从入门到精通中文视频教程 第28课 文字和表格命令(1)(个人收藏)
  8. 北京国企软件开发公司有哪些?哪家比较好呢
  9. python公众号文章_python微信公众号文章爬取
  10. 《汉魏风云》1、速度与激情——无双吕布的悲喜人生
  11. flutter 仿微信朋友圈发布图片
  12. ios14.2越狱之后的一系列操作
  13. 怎么将英文的PDF翻译成中文的
  14. sai钢笔图层怎么移动某条线?
  15. 孙俪主演的热播剧《安家》房似锦,让我们看到比贫穷更可怕的是原生家庭
  16. 数据库表空间大小查询
  17. 埃斯顿机器人 王杰高_泰州市教育局 教育动态 南京埃斯顿集团王杰高博士一行来南理工泰州科技学院开展合作交流...
  18. 最新手机枰测出炉 iPhone X仅仅名列第9名
  19. GAN 并不是你所需要的全部:从AE到VAE的自编码器全面总结
  20. 2021芯片秋招总结

热门文章

  1. sql随机生成社会统一社会信用代码
  2. 特殊格式的时间读取并排序
  3. java基础知识之加强
  4. 【编程题】【Scratch三级】2021.03 接苹果
  5. 揭秘经典案例炼成之道 微信开发者大会精华回顾
  6. js中的eval语法
  7. 机器学习笔记(3.1)
  8. 红帽考试RHCSA练习
  9. Android性能优化(三):响应优化
  10. map的put 方法的返回值 null