《从0开始设计和实现CPU》总线设计（四）之总线从属多路复用器的实现

实现功能：总线从属多路复用器的实现

1.程序源码

  /****功能：总线从属多路复用器的实现****/
`include "stddef.h"
`include "global_config.h"`include "bus.h"module bus_slave_mux(/****0号总线从属****/ input wire                 s0_cs_,     //片选input wire [`WordDataBus]  s0_rd_data, //读出的数据input wire                 s0_rdy_,    //就绪input wire                 s1_cs_,     //片选input wire [`WordDataBus]  s1_rd_data, //读出的数据input wire                 s1_rdy_,    //就绪input wire                 s2_cs_,     //片选input wire [`WordDataBus]  s2_rd_data, //读出的数据input wire                 s2_rdy_,    //就绪input wire                 s3_cs_,     //片选input wire [`WordDataBus]  s3_rd_data, //读出的数据input wire                 s3_rdy_,    //就绪input wire                 s4_cs_,     //片选input wire [`WordDataBus]  s4_rd_data, //读出的数据input wire                 s4_rdy_,    //就绪input wire                 s5_cs_,     //片选input wire [`WordDataBus]  s5_rd_data, //读出的数据input wire                 s5_rdy_,    //就绪input wire                 s6_cs_,     //片选input wire [`WordDataBus]  s6_rd_data, //读出的数据input wire                 s6_rdy_,    //就绪input wire                 s7_cs_,     //片选input wire [`WordDataBus]  s7_rd_data, //读出的数据input wire                 s7_rdy_,    //就绪/****总线主控共享信号****/ output reg [`WordDataBus]  m_rd_data, //读出的数据output reg                 m_rdy_     //就绪);/****总线从属多路复用器****/ always @(*)begin/****选择cs片选所对应的总线从属****/  if(s0_cs_ == `ENABLE_)beginm_rd_data = s0_rd_data;m_rdy_    = s0_rdy_;end else if(s1_cs_ == `ENABLE_)beginm_rd_data = s1_rd_data;m_rdy_    = s1_rdy_;end else if(s2_cs_ == `ENABLE_)beginm_rd_data = s2_rd_data;m_rdy_    = s2_rdy_;end else if(s3_cs_ == `ENABLE_)beginm_rd_data = s3_rd_data;m_rdy_    = s3_rdy_;end else if(s4_cs_ == `ENABLE_)beginm_rd_data = s4_rd_data;m_rdy_    = s4_rdy_;end else if(s5_cs_ == `ENABLE_)beginm_rd_data = s5_rd_data;m_rdy_    = s5_rdy_;end else if(s6_cs_ == `ENABLE_)beginm_rd_data = s6_rd_data;m_rdy_    = s6_rdy_;end else if(s7_cs_ == `ENABLE_)beginm_rd_data = s7_rd_data;m_rdy_    = s7_rdy_;//默认值end else beginm_rd_data = `WORD_DATA_W'h0;m_rdy_    = `DISABLE_;end  end
endmodule

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