【验证小bai】只有SV+modelsim学验证（5）——先将嗷嗷待验的DUT加入环境，至此就只遗留环境的灵魂RM了

今天我们继续向前大步迈进，把待验证的DUT加入到环境中来！为此我写了一个非常复杂的模块~~主要的功能把输入的数据打两拍然后送出去。。。。当然这只是level1.0版本，后续在添加reference module时，我一定会补充更加复杂的场景代码的！其实急着把DUT放进来主要是为了下一个博客——验证环境module与program中的time slot做准备。

闲话不多说了，先来看看我的待验证DUT模块。目前功能实在是太简单了，我就不多说啥了，最后的三个fb接口是为之后预留的，可以先不管他们。那么从代码上要连接这个dut只需要两组接口，数据输入interface和数据输出interface。

`ifndef FLOW_PROC_V
`define FLOW_PROC_Vmodule flow_proc #(parameter DATA_WIDTH = 8
)(input         clk         ,input          rst_n           ,input          data_in_vld     ,input          sop_in_vld      ,input          eop_in_vld      ,input  [DATA_WIDTH-1:0]    data_in         ,output reg         data_out_vld            ,output reg         sop_out_vld     ,output reg         eop_out_vld     ,output reg [DATA_WIDTH-1:0]    data_out        ,output         fb_vld          ,output         fb_eop          ,output         fb_cnt
);reg           data_out_vld_ff1    ;
reg         sop_out_vld_ff1     ;
reg         eop_out_vld_ff1     ;
reg [DATA_WIDTH-1:0]    dat

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