数字 IC 笔试面试必考点（8）时钟偏差以及时钟抖动

正文

时钟偏差：

Clock Skew，是指同一个时钟域内的时钟信号，到达各个模块（如寄存器）所用的时间偏差（由于布线长度不一致以及存在的线延时）。

时钟偏差主要分为两类，正偏差和负偏差：

当信号传输的目标寄存器在接收寄存器之前捕获正确的时钟信号，电路发生正偏差（时钟布线方向与数据流水方向一致）；
当信号传输的目标寄存器在接收寄存器之后捕获正确的时钟信号，电路发生负偏差（时钟布线方向与数据流水方向相反）。

时钟抖动：

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