verilog语言实现全加器

全加器是两个半加器组合而成，定义两个加数为 $in1$ ， $in2$ ,进位 $Cin$ ,和半加器一样，使用LED灯作为求和结果 $sum$ 和进位信号 $cout$ 。

相当于三个1bit的加数，先实现其中两个数的想加，输出 $sum$ 和 $cout$ ，再加第三个数。第一个半加器输入 $in1$ ， $in2$ 信号，输出 $sum$ 和 $cout$ 信号。再将输出的 $sum$ 信号和进位信号 $Cin$ 作为第二半加器的输入此时第二个半加器输出 $sum$ 和 $cout$ 信号，此时的 $sum$ 就是最终的求和信号。最后将输出的两个 $cout$ 进行或运算得到最终的 $cout$ 。

任取一点，由仿真信号知当为1，0，1想加时，求和位为0，进位位为1，与仿真结果相吻合，反仿真验证通过。

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