Verilog按位运算和逻辑运算

或运算符（|），与运算符（&）使用按位运算和逻辑运算的写法不同。以或运算符为例。按位或为（|），逻辑或为（||）。特别注意，按位取反为（~），逻辑取反为（！）

上方为按位或，将ab两个向量进行按位或运算。中间为逻辑或，ab两个向量自己会先进行每位的或运算并分别得到一个一位的值，再进行逻辑或。

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