简单通用的Makefile编写例子

Makefile的语法很多，编写起来也比较麻烦，日常工作中我们可能需要编写一些简单的测试程序，每次编写Makefile文件比较麻烦，本着拿来主义的原则，编写了一个通用的Makefile示例，供大家交流使用，支持路径的修改，支持改动增量编译。
例子中具体每行的含义，大家可以百度查一下，或者参考《跟我一起写 Makefile》看一下，本文仅仅是分享成品，不做详细阐述。

CC = gcc
CFLAGS = -g -Wall -std=c99
CLIBS = -lpthreadSRC_PATH = src
OBJ_PATH = obj
BIN_PATH = binTARGET = ${BIN_PATH}/test.binINCLUDE = $(wildcard $(SRC_PATH)/*.h)
SOURCES = $(wildcard $(SRC_PATH)/*.c)OBJECTS = $(patsubst $(SRC_PATH)/%.c,$(OBJ_PATH)/%.o, $(SOURCES))
DEPENDS = $(patsubst $(SRC_PATH)%.c,$(OBJ_PATH)/%.d, $(SOURCES))sinclude $(DEPENDS)$(TARGET) : $(OBJECTS)$(CC) $(CFLAGS) $^ -o $@ $(CLIBS)$(OBJ_PATH)/%.o : $(SRC_PATH)/%.c$(CC) $(CFLAGS) -c $< -o $@ -MMD -MF $(OBJ_PATH)/$*.d -MP@echoall : $(TARGET).PHONY : clean
clean:rm -rf $(OBJ_PATH)/*.d $(OBJ_PATH)/*.o $(TARGET)

本示例的代码目录如下，大家也可以通过修改Makefile文件里的变量进行修改。

.
├── bin
├── Makefile
├── obj
└── src├── main.c├── main.o

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