原理

dds信号发生器：以rom为核心，外围控制输出地址，达到输出不同频率和相位或者幅度的结构。（这里不考虑ad转换和滤波）
这里以正弦信号为例，用专用软件或者matlab生成一组正弦信号值的文件，这里使用quartus自带的ip核，将文件读入rom。
剩下的就是控制输出地址来达到改变频率、相位和幅度的目的。

实现

这里分为3个模块
一个模块实现按键消抖
一个模块实现dds具体功能
一个模块为rom例化

按键消抖模块
使用2个按键，模块消抖后输出高电平有效

module key_debounce #(parameter KEY_W = 2,TIME_20MS = 1000_000)(input                  clk     ,input                  rst_n   ,input      [KEY_W-1:0] key_in  ,output reg [KEY_W-1:0] key_out  //检测到按下，输出一个周期的高脉冲，其他时刻为0
);//信号定义reg     [19:0]      cnt     ;wire               add_cnt ;wire               end_cnt ;reg                    add_flag;reg        [KEY_W-1:0] key_r0  ;//同步按键输入reg        [KEY_W-1:0] key_r1  ;//打拍wire   [KEY_W-1:0] nedge   ;//检测下降沿//计数器  检测到下降沿的时候，开启计数器延时20msalways @(posedge clk or negedge rst_n)begin if(!rst_n)begin cnt <= 0;endelse if(add_cnt)begin if(end_cnt)cnt <= 0;else cnt <= cnt + 1;end          end assign add_cnt = add_flag;assign end_cnt = add_cnt && cnt == TIME_20MS-1;//检测到下降沿的时候，拉高计数器计数使能信号，延时结束时，再拉低使能信号always @(posedge clk or negedge rst_n)begin if(!rst_n)begin add_flag <= 1'b0;end else if(nedge)begin add_flag <= 1'b1;end else if(end_cnt)begin add_flag <= 1'b0;end end //同步按键输入，并打一拍，以检测下降沿always @(posedge clk or negedge rst_n)begin if(!rst_n)begin key_r0 <= {KEY_W{1'b1}};key_r1 <= {KEY_W{1'b1}};end else begin key_r0 <= key_in;//同步key_r1 <= key_r0;//打拍end endassign nedge = ~key_r0 & key_r1;//延时20ms结束的时钟周期，输出按键的状态，若按下输出一个周期的高脉冲，否则输出0always@(posedge clk or negedge rst_n)begin if(~rst_n)begin key_out <= 0;end else begin key_out <= end_cnt?~key_r1:0;end end endmodule

dds模块

这里输入一个设置按钮和设置完成按钮
按下设置按钮，临时频率步长寄存器加1，
按下设置完成按钮，将频率步长加上临时频率步长寄存器的值
最后一个always块一直将频率赋值给相位控制器（实际上就是rom地址）

module dds(input             clk     ,input          rst_n   ,input           freq_set,input           set_done,output [9:0]    addr
);
//信号定义
reg [7:0] freq_tmp;//频率控制字
reg [7:0] freq;reg [9:0] phas_add ;//相位累加器//频率控制字变化
always@(posedge clk or negedge rst_n)beginif(!rst_n)beginfreq_tmp <= 8'd0;endelse if(freq_set == 1'b1)beginfreq_tmp <= freq_tmp + 1'd1;endelse if(set_done)beginfreq_tmp <= 8'd1;end
endalways@(posedge clk or negedge rst_n)beginif(!rst_n)beginfreq <= 1'b1;endelse if(set_done)beginfreq <= freq + freq_tmp;end
endalways@(posedge clk or negedge rst_n)beginif(!rst_n)beginphas_add <= 1'b0;endelse beginphas_add <= phas_add + freq;end
end
assign addr = phas_add;
endmodule

顶层

module dds_top(input             clk         ,input          rst_n       ,input  [1:0]   key_in      ,output     [7:0]   dout
);wire [1:0] key_out;
//参数定义
key_debounce #(.KEY_W(2)) u_key(.clk        (clk        ),.rst_n        (rst_n      ),.key_in   (key_in     ),.key_out  (key_out    ) //检测到按下，输出一个周期的高脉冲，其他时刻为0
);
wire [9:0] addr;
dds u_dds(.clk      (clk        ),.rst_n        (rst_n      ),.freq_set (key_out[0] ),//频率控制字.set_done  (key_out[1] ),.addr     (addr       )
);rom1  rom1_inst (.address     ( addr  ),.clock        ( clk   ),.q            ( dout  ));endmodule

signal tap调试

总结：原理不难，就是实现的时候思路不容易清晰，这里只实现了频率的改变，还可以实现相位的改变，如在dds模块中加一个相位寄存器就行，加一个相位按钮，按下相位就加90度，其实就是加整个正弦数据地址的1/4，我这里是1024长度，就可以设置为256，幅度的话，可以将rom输出的值直接改变。更复杂的话，我就不知道了。

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