关于STM32F105/107时钟配置详解

本文用的是标准库，先给出时钟配置代码，代码在system_stm32f10x.c里面。
首先定义最终系统频率72MHz：

如果是其他频率把72的注释掉，打开你想配置的频率。这个频率并不会影响实际的设置，而只是指明了当前频率。如果定义了SYSCLK_FREQ_72MHz，会编译以下两部分：

SystemCoreClock是一个全局变量，表示当前系统时钟频率。

由上图看到实际会编译SetSysClockTo72()这个函数。
在这个函数内部，最重要的有两个寄存器设置：

此处注意，F105/107属于互联型，启动文件为 startup_stm32f10x_cl.s且必须宏定义STM32F10X_CL
在这里互联型芯片系统默认外部高速时钟是25MHz，由于一个CFGR寄存器是无法倍频到72MHz的，所以互联型芯片有两个CFGR寄存器，首先对时钟源进行分频与倍频的是CFGR2寄存器，所以先要设置CFGR2寄存器，在上图里，对外部高速时钟进行的配置是：
25/5*8=40MHz这个是PLL2CLK的频率
PLL2CLK/5=8MHz这个是PREDIV1CLK的频率
在分析时钟时我们借用CubeMx可以更加直观：

可以看到经过CFGR2寄存器对HSE操作后，我们得到了一个8MHz的时钟源，接下来只要把8X9=72MHz即可，这可以通过设置CFGR寄存器得到。
下面举个例子，假如我们外部高速时钟是8MHz，我们怎么得到72MHz的系统时钟：
首先我们可以直接用CubeMx来生成我们需要的分频与倍频：
把HSE时钟改为8MHz，把系统时钟改为72MHz，得到下面设置：

可以看到只改动了两个地方。对照代码我们做以下修改：

至此，F105时钟修改完成。
附寄存器定义：
CFGR2:

CFGR:

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