RapidIO PCB布线要求
阻抗
互连线的设计应遵循差动对的标准做法,形成差分对的两个信号应紧密耦合。差分对的间距要大。
Skew
为了最小化RapidIO通道上的skew,每个单向通道内每个道的总长度应该相等.
因为RapidIO模型是源同步的,所以总长度并不重要。最好的信号完整性是上图第三种模式Opposed。
side-by-side需要两个布线层,并且由于层之间的通道而降低了信号的完整性。以保持总长度相等。两层必须有相同的相位。
最后,直角布线需要弯曲以均衡延迟,弯曲路段在增加辐射的同时降低了信号的完整性。有必要在第二层上放置弯曲的部分。
PCB叠层
PCB堆叠对RapidIO通道高频操作产生的电磁干扰有显著影响,因此必须从一开始就规划电磁干扰控制。如图所示。
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