1. 打开ModelSim,新建工程->新建Verilog文件demo.v
    输入文件内容
module demo();reg[3:0]    a,b;initialbegin$display("Hello, World");a = 2;b = 5;$display("answer = %b", (a+b));end
endmodule

2.依次点击 编译和仿真

3. 选择work->demo

4. 在transcript里输入run查看$display结果

转载于:https://www.cnblogs.com/lepeCoder/p/7230544.html

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