HDL—Verilog Language—Vectors

Given an 8-bit input vector [7:0], reverse its bit ordering.

给定一个8位输入矢量[7:0]，反转其位顺序。

利用上一个位拼接运算符，可以把in每一位反过来拼接起来，然后输出。

module top_module(
    input [7:0] in,
    output [7:0] out
);
    assign out = {in[0],in[1],in[2],in[3],in[4],in[5],in[6],in[7]} ;
endmodule

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