使用M0 DesignStart 的样例SoC(example system) - 3 verdi环境配置
对样例SoC配置verdi,用其进行debug
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使用verdi快速启动,节省编译时间
使用verdi快速启动,节省编译时间
首先VCS能够工作的前提是有filelist(vcs使用-f参数),
VCS需要对RTL源文件进行编译,然后仿真,顺带着能够生成波形文件(VCS使用-fsdb选项就会产生供verdi使用的层级关系),
正因为编译,才能知道设计文件的层级关系
VCS = 源文件(编译后得到层级关系) + 仿真 + 生成fsdb波形
再来看verdi,正常情况下,它也需要对源文件进行编译才能显示层级关系
此外,还需要波形文件
Verdi = 源文件(编译后得到层级关系)+ 读取fsdb波形
如果使用这种方式,verdi可能有需要编译一遍,效率很低
那么verdi能够直接用VCS编译之后的结果快速启动吗?如何做呢?
VCS Compile阶段加上“-kdb -lca”这个选项,这样就能在VCS Compile中看到simv.daidir/kdb.elab++这个目录,这个目录就是VCS为Verdi产生的库,其实就是VCS帮Verdi生成了一个Verdi认识的中间文件
如果有了simv.daidir/kdb.elab++库文件, 可以用“Verdi -elab simv.daidir/kdb" 命令打开Verdi。用这种方式,启动GUI界面仍然少不掉,但是会把Verdi Compile filelist.f的时间改为import库文件,这一步几乎是瞬间完成,因此能节省不少时间
这样就是能够节省下来verdi拿到源文件然后编译的时间了~~~
具体做法
首先在testbench中添加语句
initial begin$fsdbDumpfile("tb.fsdb");$fsdbDumpvars();end
然后添加vcs的编译选项,然后编译仿真运行,
-full64 //产生64位的可执行文件,不加这一个选项,vcs编译的时候可能出错
-fsdb //产生fsdb波形
-lca -kdb //产生供verdi使用的中间文件simv.daidir/kdb.elab++,减少Verdi编译时间
最后启动Verdi
verdi -ssy -ssv -elab simv.daidir/kdb //读取vcs的产生的中间文件,并解析出文件结构
-ssf tb.fsdb //读取波形文件
-nologo //不会出现verdi的启动界面
& //linux命令,表示后台运行
ps:Verdi的 -ssy -ssv 选项
现在的VCS的filelist并不是指定具体的文件,而是通过指定文件夹,让VCS在文件夹下自动找到RTL文件
VCS有时候还会使用-y选项和-v选项(感兴趣的自己查阅~~)
verdi在这样的情况下是解析不了层级结构的;
因此为了解决这个问题,Verdi使用-ssy -ssv来正常显示文件结构
参考博客:
http://blog.sina.com.cn/s/blog_13f7886010102xqlu.html
参考文章:
https://wenku.baidu.com/view/3d9a68ebf021dd36a32d7375a417866fb94ac042.html
https://wenku.baidu.com/view/5ca5f8c231126edb6e1a1098.html
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