FPGA实现A5算法并仿真

A5算法仿真，FPGA是digilent平台下的，在vivado软件平台下创建工程，使用的是vhdl语言

下面是工程截图：

仿真截图如下：

library IEEE;
use IEEE.STD_LOGIC_1164.ALL;
use ieee.std_logic_arith.all;
use ieee.std_logic_unsigned.all;

entity a5 is
port(reset,clk:in std_logic;
Key:in std_logic_vector(63 downto 0);
qout:out std_logic;
cipher_out:out std_logic_vector(63 downto 0);
plain_out:ou

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