好了，贴源码！

//common.h

[cpp] view plaincopy
  1. #ifndef COMMON_H
  2. #define COMMON_H
  3. typedef unsigned long uint32;
  4. #define MASK_CODE(LSB_LOCATION,FIELD_LEN)                   ((((uint32)1<<FIELD_LEN)-1)<<LSB_LOCATION)
  5. #define FILL_BITS(MEM_ADDR,LSB_LOCATION,FIELD_LEN,VALUE)    (*(volatile uint32 *)(MEM_ADDR)) = ( (*(volatile uint32 *)(MEM_ADDR)) & ~MASK_CODE((LSB_LOCATION),(FIELD_LEN)) ) | ( ((uint32)(VALUE)<<(LSB_LOCATION)) & MASK_CODE((LSB_LOCATION),(FIELD_LEN)) )
  6. //注：FILL_BITS(MEM_ADDR,LSB_LOCATION,FIELD_LEN,VALUE)这个宏，它执行的操作是，
  7. //用VALUE这个数填充MEM_ADDR地址处从第LSB_LOCATION位开始的FIELD_LEN个位.
  8. #define SET_REG(REG_ADDR,LSB_LOCATION,FIELD_LEN,VALUE)          FILL_BITS(REG_ADDR,LSB_LOCATION,FIELD_LEN,VALUE)
  9. #endif

//clock.h

[cpp] view plaincopy
  1. #ifndef CLOCK_H
  2. #define CLOCK_H
  3. #include"common.h"
  4. #define CONFIG_SYS_CLK_FREQ 12000000
  5. void set_sys_clk(uint32 mode);
  6. uint32 get_ARMCLK(void);
  7. uint32 get_FCLK(void);  //即APLL
  8. uint32 get_HCLK(void);
  9. uint32 get_PCLK(void);
  10. void change_freq(uint32 arm_ratio,uint32 hclkx2_ratio,uint32 hclk_ratio,uint32 pclk_ratio);
  11. //  0-15        0-7                0-1          0-15
  12. //这四个参数加1后才是实际分频。
  13. #define rAPLL_LOCK      (*(volatile uint32 *)(0x7e00f000))
  14. #define rMPLL_LOCK      (*(volatile uint32 *)(0x7e00f004))
  15. #define rEPLL_LOCK      (*(volatile uint32 *)(0x7e00f008))
  16. #define rAPLL_CON   (*(volatile uint32 *)(0x7E00F00C))
  17. #define rMPLL_CON   (*(volatile uint32 *)(0x7E00F010))
  18. #define rEPLL_CON0  (*(volatile uint32 *)(0x7E00F014))
  19. #define rEPLL_CON1  (*(volatile uint32 *)(0x7E00F018))
  20. #define rCLK_SRC    (*(volatile uint32 *)(0x7E00F01C))
  21. #define rOTHERS         (*(volatile uint32 *)(0x7E00F900))
  22. #define rMISC_CON   (*(volatile uint32 *)(0x7E00F838))
  23. #define rCLK_DIV0   (*(volatile uint32 *)(0x7E00F020))
  24. //--------
  25. #define _APLL_MDIV  1000        //reset: 0x190  ,10bits
  26. #define _APLL_PDIV  10      //reset: 0x3    ,6bits
  27. #define _APLL_SDIV  1       //reset: 0x2    ,3bits
  28. #define _MPLL_MDIV  1000        //reset: 0x214  ,10bits
  29. #define _MPLL_PDIV  10      //reset: 0x6    ,6bits
  30. #define _MPLL_SDIV  1       //reset: 0x3    ,3bits
  31. #define _ARM_RATIO  2       //0-15
  32. #define _HCLKX2_RATIO   3       //0-7
  33. #define _HCLK_RATIO 0       //0-1
  34. #define _PCLK_RATIO 3       //0-15
  35. /*
  36. PLL_FOUT:
  37. FOUT = MDIV X FIN / (PDIV X 2^SDIV)
  38. MDIV: 64 ≤ MDIV ≤ 1023
  39. PDIV: 1 ≤ PDIV ≤ 63
  40. SDIV: 0 ≤ SDIV ≤ 5
  41. FVCO (=MDIV X FIN / PDIV): 800MHz ≤ FVCO ≤ 1600MHz
  42. FOUT: 40MHz ≤ FVCO ≤ 1600MHz
  43. FIN : 10MHz ≤ FIN ≤ 20MHz
  44. Don't set the value P and M to all zeros.
  45. CLK:
  46. ARM_CLK     =   APLLOUT / (_ARM_RATIO+1)
  47. HCLKX2      =   MPLLOUT / (_HCLKX2_RATIO+1)
  48. HCLK        =   HCLKX2  / (_HCLK_RATIO+1)
  49. PCLK        =   HCLKX2  / (_PCLK_RATIO+1)
  50. 设置时还需注意HCLK必须是PCLK的整偶倍数
  51. */
  52. #endif

需要修改频率时，只需修改clock.h文件中的下列宏的值即可：

[cpp] view plaincopy
  1. //--------
  2. #define _APLL_MDIV  1000        //reset: 0x190  ,10bits
  3. #define _APLL_PDIV  10      //reset: 0x3    ,6bits
  4. #define _APLL_SDIV  1       //reset: 0x2    ,3bits
  5. #define _MPLL_MDIV  1000        //reset: 0x214  ,10bits
  6. #define _MPLL_PDIV  10      //reset: 0x6    ,6bits
  7. #define _MPLL_SDIV  1       //reset: 0x3    ,3bits
  8. #define _ARM_RATIO  2       //0-15
  9. #define _HCLKX2_RATIO   3       //0-7
  10. #define _HCLK_RATIO 0       //0-1
  11. #define _PCLK_RATIO 3       //0-15

//clock.c

[cpp] view plaincopy
  1. #include"clock.h"
  2. //注：FILL_BITS(MEM_ADDR,LSB_LOCATION,FIELD_LEN,VALUE)这个宏，它执行的操作是，
  3. //用VALUE这个数填充MEM_ADDR地址处从第LSB_LOCATION位开始的FIELD_LEN个位.
  4. void set_sys_clk(uint32 mode)
  5. {                                   //mode:     0:asyn mode 异步模式
  6. //      other:syn  mode 同步模式
  7. //两种模式的区别参考3-3页的Figure 3.2
  8. uint32 *p;
  9. uint32 temp;
  10. rAPLL_LOCK = 0xffff;
  11. rMPLL_LOCK = 0xffff;
  12. rMISC_CON &= ~(1u<<19);                        //SYNC667  0 : Normal Moe, 1 : Sync 667MHz Mode。       这里选用Normal mode
  13. if(mode==0)
  14. {
  15. //设置同步模式为异步
  16. rOTHERS &= ~0x80;                              //异步模式
  17. while((rOTHERS & 0xf00) != 0);                  //等待OTHERS的8~11位为0
  18. rOTHERS &= ~0x40;
  19. }
  20. else
  21. {
  22. //设置为同步模式。
  23. rOTHERS |= 0x40;                              //同步模式
  24. __asm{
  25. nop;
  26. nop;
  27. nop;
  28. nop;
  29. nop;
  30. }
  31. rOTHERS |= 0x80;
  32. while((rOTHERS & 0xf00) != 0xf00);             //等待OTHERS的8~11位为1111
  33. }
  34. //设置ARMCLK,HCLKX2,HCLK和PCLK
  35. temp=rCLK_DIV0;
  36. p=&temp;
  37. FILL_BITS(p,0,4,_ARM_RATIO);
  38. FILL_BITS(p,9,3,_HCLKX2_RATIO);
  39. FILL_BITS(p,8,1,_HCLK_RATIO);
  40. FILL_BITS(p,12,4,_PCLK_RATIO);
  41. rCLK_DIV0=temp;
  42. //设置APLL，得到APLLOUT
  43. temp=rAPLL_CON;
  44. p=&temp;
  45. FILL_BITS(p,16,10,_APLL_MDIV);
  46. FILL_BITS(p,8,6,_APLL_PDIV);
  47. FILL_BITS(p,0,3,_APLL_SDIV);
  48. temp |= (1u<<31);
  49. rAPLL_CON=temp;
  50. //设置MPLL，得到MPLLOUT
  51. temp=rMPLL_CON;
  52. p=&temp;
  53. FILL_BITS(p,16,10,_MPLL_MDIV);
  54. FILL_BITS(p,8,6,_MPLL_PDIV);
  55. FILL_BITS(p,0,3,_MPLL_SDIV);
  56. temp |= (1u<<31);
  57. rMPLL_CON=temp;
  58. //选择源
  59. temp=rCLK_SRC;
  60. p=&temp;
  61. FILL_BITS(p,0,1,1);     //选择APLLOUT
  62. FILL_BITS(p,1,1,1);     //选择MPLLOUT
  63. rCLK_SRC=temp;
  64. }
  65. void change_freq(uint32 arm_ratio,uint32 hclkx2_ratio,uint32 hclk_ratio,uint32 pclk_ratio)
  66. {       //  0-15        0-7     0-1     0-15
  67. uint32 *p;
  68. uint32 temp;
  69. temp=rCLK_DIV0;
  70. p=&temp;
  71. FILL_BITS(p,0,4,arm_ratio);
  72. FILL_BITS(p,9,3,hclkx2_ratio);
  73. FILL_BITS(p,8,1,hclk_ratio);
  74. FILL_BITS(p,12,4,pclk_ratio);
  75. rCLK_DIV0=temp;
  76. }
  77. #define APLL 1
  78. #define MPLL 2
  79. #define EPLL 3
  80. static uint32 get_PLLCLK(int pllreg)    //返回0说明异常
  81. {
  82. uint32 r, m, p, s;
  83. if (pllreg == APLL)
  84. r = rAPLL_CON;
  85. else if (pllreg == MPLL)
  86. r = rMPLL_CON;
  87. else if (pllreg == EPLL)
  88. r = rEPLL_CON0;
  89. else
  90. return 0;
  91. m = (r>>16) & 0x3ff;
  92. p = (r>>8) & 0x3f;
  93. s = r & 0x7;
  94. return (m * (CONFIG_SYS_CLK_FREQ / (p * (1 << s))));
  95. }
  96. /* return ARMCORE frequency */
  97. uint32 get_ARMCLK(void)
  98. {
  99. uint32 div;
  100. div = rCLK_DIV0;
  101. return (get_PLLCLK(APLL) / ((div & 0x7) + 1));
  102. }
  103. /* return FCLK frequency */
  104. uint32 get_FCLK(void)
  105. {
  106. return (get_PLLCLK(APLL));
  107. }
  108. /* return HCLK frequency */
  109. uint32 get_HCLK(void)
  110. {
  111. uint32 fclk;
  112. uint32 hclkx2_div = ((rCLK_DIV0>>9) & 0x7) + 1;
  113. uint32 hclk_div = ((rCLK_DIV0>>8) & 0x1) + 1;
  114. if(rOTHERS & 0x80)
  115. fclk = get_FCLK();      // SYNC Mode
  116. else
  117. fclk = get_PLLCLK(MPLL);    // ASYNC Mode
  118. return fclk/(hclk_div * hclkx2_div);
  119. }
  120. /* return PCLK frequency */
  121. uint32 get_PCLK(void)
  122. {
  123. uint32 fclk;
  124. uint32 hclkx2_div = ((rCLK_DIV0>>9) & 0x7) + 1;
  125. uint32 pre_div = ((rCLK_DIV0>>12) & 0xf) + 1;
  126. if(rOTHERS & 0x80)
  127. fclk = get_FCLK();      // SYNC Mode
  128. else
  129. fclk = get_PLLCLK(MPLL);    // ASYNC Mode
  130. return fclk/(hclkx2_div * pre_div);
  131. }

set_sys_clk(uint32 mode)函数既设置锁相环又根据已定义好的宏设置ARMCLK和HCLK等的分频。mode为0时为异步模式，为1时为同步模式。初始化时一般用这个函数。

change_freq(uint32,uint32,uint32,uint32)根据输入的参数设置ARMCLK和HCLK等的分频，但不改变PLL的设置。通过这个函数可以快捷的实现动态变频。

其他的get*****()函数就请读者自己看吧。

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