VHDL基本门电路和数值比较器的设计

主要内容：利用VHDL设计基本门电路和数值比较电路模块，并使用EDA 工具对各模块进行仿真验证。基本门电路模块中包含与门、或门、异或门等6个基本电路。数值比较器模块用来实现两个数值比较，结果用特定的二进制编码来表示。
要求：
（1）通过设计计算机各组成部件的器件、设计指令系统及对应的模型机、做复杂模型机的实验, CPU系统与存储器扩展设计、接口技术应用设计等课题，掌握计算机组成和接口技术的基本分析方法和设计方法,加深和巩固对理论教学和实验教学内容的掌握，进一步建立计算机系统整体概念，初步掌握微机硬件开发方法，为以后进行实际的计算机软、硬件应用开发打下良好的基础。
（2）熟练操作设计所用的软硬件系统：TDN-CM++实验系统或EDA软件。
（3）按要求编写课程设计报告，正确绘制程序流程图、实验接线图等，正确阐述设计原理、方法和实验结果。
（4）通过课程设计培养学生严谨的科学态度，认真地工作作风和团队协作精神。
（5）在老师的指导下，要求每个学生独立完成课程设计报告的全部内容。

摘要系统采用EDA技术设计基本门电路和数值比较器中的两个部分，基本门电路模块中包含与门、或门、异或门等6个基本电路。数值比较器模块用来实现两个数值比较，结果用特定的二进制编码来表示。系统采用硬件描述语言VHDL把电路按模块化方式进行设计，然后进行编程、时序仿真等。各个模块的结构简单，使用方便，具有一定的应用价值。

该设计包括实验报告和代码，下面是截图：

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