Chips-2.0（二）DEMO工程综合实现

1.安装numpy

sudo apt-get update
sudo apt-get install python-numpy

2.在Github上克隆例程

git clone https://github.com/dawsonjon/FPGA-radio.git
cd FPGA-radio/

3.运行如下代码时，显示没有需要VIVADO

./run_demo.py radio nexys_4 compile build download run #full build process

我虚拟机下安装了VIVADO，但是暂时不知道怎样把安装路径告诉Chips。那就试试compile：

./run_demo.py radio nexys_4 compile

执行上述命令后，在systhesis/nexys_4下生成了一堆verilog文件
4.修改VIVADO路径
打开FPGA-radio/demo/user_settings.py，把VIVADO路径修改为实际安装目录：

vivado = "/opt/Xilinx/Vivado/2019.1/bin/"

5.继续运行如下命令

./run_demo.py radio nexys_4 compile build download run #full build process

报错：

ERROR: [Synth 8-3512] assigned value '-2147483648' out of range [/home/zkf/FPGA-radio/synthesis/nexys_4/radio/rectangular_to_polar.vhd:78]

分析可能是数值太大越界了，先把FPGA-radio/demo/bsp_components/rectangular_to_polar.vhd第78行注释掉，一定要修改这个路径下的rectangular_to_polar.vhd，因为这里是源头，如果修改/FPGA-radio/synthesis/nexys_4/radio/rectangular_to_polar.vhd是没用的，因为重新运行命令时，会从FPGA-radio/demo/bsp_components/rectangular_to_polar.vhd拷贝过来，并覆盖。
6.再运行如下命令

./run_demo.py radio nexys_4 compile build download run #full build process

最终可以顺利生成bit文件，并自动下载到nexys_4开发板，由于我没有这个开发板，暂时不能上板验证。

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