1.带clocking block 的interface

2.packet（transaction）

分为ipacket（interface的输入）和opacket（interface的输出）

3.driver：

其中定义了一些功能覆盖率

4.iMonitor：

master_agent中的monitor，用于监控DUT的输入

5.master_agent

其中封装了sequencer、driver、monitor

并将sequencer与driver连接起来

6.oMonitor

slave_agent中的monitor，监控DUT的输出

7.slave_agent

仅仅封装了oMonitor

8.sram_env

其中包含了master_agent,slave_agent,ref_model,scoreboard

9.ref_model

10.scoreboard

11.base_test

12.tb_top

13.sequence

搭建好环境后写个简单的sequence去跑：写个数，读个数

跑出波形如下图

第一个clk，控制信号使能（hsel，hwrite，hready，haddr）

第二个clk，数据有效（hready有效的前提下），给sram_addr[14:2] = aa地址写了32‘haaaa_aaaa

读操作

第一个clk，控制信号使能（hwrite拉低，地址依旧为sram_addr[14:2] = aa），因此在下一拍读出数据hrdata = 32‘haaaa_aaaa

14.Makefile

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