杭电数电实验(二)译码器
源代码
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endmodule
仿真代码
module Decoder_test;reg G1,G2,G3;reg A,B,C;wire [7:0] Y;decoder uut(G1,G2,G3,A,B,C,Y);initialbegin G1=1;G2=0;G3=0;{A,B,C}=0;endalwaysbegin #10C=0;B=0;A=1;#10C=0;B=1;A=0;#10C=0;B=1;A=1;#10C=1;B=0;A=0;#10C=1;B=0;A=1;#10C=1;B=1;A=0;#10C=1;B=1;A=1;#10G1=1;G2=1;G3=1;#10G1=1;G2=0;G3=1;#10G1=0;G2=1;G3=1;#10G1=0;G2=0;G3=0;end
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