SV学习笔记—区分always和initial
首先要清楚哪些语句应该被放置于硬件世界，哪些程序应该被放置于软件世界？
硬件世界：module/endmodule，interface/endinterface
软件世界：program/endprogram，class/endclass
1.always块儿：
- always是为了描述硬件的行为，只可以在module或者interface中使用，在使用时需要注意：哪种使用方式是时序电路描述，哪种使用方式是组合电路描述,其反复执行
- always中的@(event..)敏感列表是为了模拟硬件信号的触发行为，因此要根据描述的是组合电路还是时序电路定义信号触发行为
2.initial块儿：
- initial从名字也可以看得出来，与always在执行路径上有明显区别，即initial非常符合软件的执行方式，即只执行一次
- initial和always一样，无法被延迟执行，即在仿真一开始它们都会同时执行，即initial和always块儿会并行执行，但这俩内部都是顺序执行
- initial从其执行路径的属性来看，它不应该存在于硬件设计代码中，它本身不可综合，对于描述电路没有任何帮助
- initial就是为了测试而生的，由于测试需要按照时间顺序的习惯即软件方式来完 成，所以initial便可以实现这一要求；但当用verilog执行简单验证时，initial也出现在module中。
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