FPGA NCO+LPM_MULT+FIRip核 实现乘法+低通滤波 使用及仿真（quartusii 13.1+modelsimse 10.5）
目录
一、RTL Viewer：
二、IP核的使用
三、代码编写
四、结果
一、RTL Viewer：
二、IP核的使用
1、使用NCOip核产生两个4.5MHz和5MHz的正弦信号（位宽均为10位）：sin4500、sin5000，方法可以从之前的文章中找到。
2、调用乘法器ip核：LPM_MULT,命名为ip_mult。
乘法器参数设置：
3、调用firIP核，注意输入位乘法器的输出，20位的数据。
三、代码编写
module multiplying(input sys_clk,input sys_rst_n,output signed[9:0] sin4500,output sin4500_vld,output signed[9:0] sin5000,output sin5000_vld,output signed[19:0] mult_sin,output mult_vld,output signed [37:0] fir_out);wire signed[19:0] sin ;
wire signed[9:0] sin4500_do ;
wire signed[9:0] sin5000_do ;
wire s_err ;
wire s_val ;assign sin4500 = sin4500_do;
assign sin5000 = sin5000_do;
assign mult_sin = sin;
assign mult_vld = sin4500_vld & sin5000_vld;//4.5Mhzsin_4500 u_sin_4500(.clk ( sys_clk ),.reset_n ( sys_rst_n ),.clken ( 1'b1 ),.phi_inc_i ( 32'd386547000),.fsin_o ( sin4500_do ),.out_valid ( sin4500_vld ));//5Mhzsin_5000 u_sin_5000(.clk ( sys_clk ),.reset_n ( sys_rst_n ), .clken ( 1'b1 ),.phi_inc_i ( 32'd429497000),.fsin_o ( sin5000_do ),.out_valid ( sin5000_vld ));ip_mult ip_mult_inst (.clken (1'b1 ),.clock (sys_clk),.dataa ( sin4500_do[9:0] ),.datab ( sin5000_do[9:0]),.result ( sin[19:0]));fir u_fir(.clk ( sys_clk ), .reset_n ( sys_rst_n ), .ast_sink_data ( sin ), .ast_sink_valid ( mult_vld ), .ast_sink_error ( 2'b0 ), .ast_source_ready ( 1'b1 ), .ast_source_data ( fir_out ), .ast_source_valid ( s_val ), .ast_source_error ( s_err ));endmoduleTest benches：
`timescale 1ns/1nsmodule tb_multiplying();//输入信号
reg sys_clk ;
reg sys_rst_n ;//输出信号
wire [9:0] sin4500 ;
wire sin4500_vld ;
wire [9:0] sin5000 ;
wire sin5000_vld ;
wire [19:0] mult_sin ;
wire mult_vld ;
wire [37:0] fir_out ;initialbeginsys_clk = 1'b1;sys_rst_n <= 1'b0;#20sys_rst_n <= 1'b1;endalways #10 sys_clk = ~sys_clk;//模块例化multiplying u_multiplying(.sys_clk ( sys_clk ),.sys_rst_n ( sys_rst_n ),.sin4500 ( sin4500 ),.sin4500_vld ( sin4500_vld ),.sin5000 ( sin5000 ),.sin5000_vld ( sin5000_vld ),.mult_sin ( mult_sin ),.mult_vld ( mult_vld ),.fir_out ( fir_out ));endmodule注意： 先整体运行一遍将生成的.vo文件添加到文件中，才能成功仿真。
四、结果
可以看到最后只剩下了0.5MHz的频率。
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