概述：

什么是VHDL：

VHDL—Very-High-Speed Integrated circuit Hardware Description Language

VHDL的起源及发展：

80年代初，由美国国防部在实施超高速集成电路（VHSIC）项目时开发的

1987年，IEEE协会批准为IEEE工业标准，称为IEEE1076-1987

1993年，被更新为93标准，IEEE1076.93

1996年，IEEE1076.3称为综合标准

使用VHDL的目的：

把电子电路的设计意义以文字或文件的形式保存起来，以便其它人能方便地了解电路的设计意义

VHDL的用途：

主要用于描述字系统的结构、行为、功能和接口

VHDL与verilog HDL的比较：

相同点：

都是主要的硬件描述语言

都能以文本形式抽象表示电路的行为和结构

都可以从系统行为级，寄存传输门寄存器传输级和门级进行电路描述

不同点：

语法差异，verilo g是类 C语言，简单易用，而VHDL语句较为晦涩，使用难度大

VHDL侧重于系统描述，更适合系统级设计

Verilog 侧重于电路级描述，更适合电路设计

VHDL特点：

系统硬件描述能力强

与器件无关，与工艺无关

IEEE工业标准

方法灵活，技术齐全

可读性好

举例：二路选择器描述的变化

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