【计算机组成原理】运算器组成实验
运算器组成实验
文章目录
- 运算器组成实验
- 一、多位串行加法器和多位可控加减电路的设计
- (1)1.8位串行加法器设计
- (2)8位可控加减法器设计
- 二、快速加法器设计
- (1)4位先行进位电路设计
- (2)4位快速加法器设计
- (3)16位的快速加法器设计
- (4)32位的快速加法器设计
- 三、ALU单元设计
- (1)32位ALU单元设计
- 四、阵列乘法器设计
- (1)5位乘法与门阵列
- (2)不带符号的5位阵列乘法器
- 五、阵列除法器设计
- (1)一位可控加减单元的电路设计
- (2)4位阵列除法器设计
一、多位串行加法器和多位可控加减电路的设计
(1)1.8位串行加法器设计
- 一位全加器FA封装电路图
- 8位串行加法器电路图
- 8位串行加法器无溢出测试：
- 8位串行加法器溢出测试：
(2)8位可控加减法器设计
- 8位可控加减法器电路图
- 8位可控加减法器测试图
- 8位可控加减法器加法测试图
- 8位可控加减法器减法测试图
- 8位可控加减法器加法测试图
二、快速加法器设计
(1)4位先行进位电路设计
- 4位先行进位电路图
(2)4位快速加法器设计
4位快速加法器电路图
4位快速加法器逻辑表达式：
Gi=XiYiG_i = X_iY_iGi=XiYi
Pi=Xi⊕YiP_i = X_i⊕YiPi=Xi⊕Yi
S1=P1⊕C0S_1 = P_1⊕C_0S1=P1⊕C0
S2=P2⊕C1S_2 = P_2⊕C_1S2=P2⊕C1
S3=P3⊕C2S_3 = P_3⊕C_2S3=P3⊕C2
S4=P4⊕C3S_4 = P_4⊕C_3S4=P4⊕C3
C1=G1+P1C0C_1 =G_1+P_1C_0C1=G1+P1C0
C2=G2+P2G1+P2P1C0C_2 =G_2+P_2G_1+P_2P_1C_0C2=G2+P2G1+P2P1C0
C3=G3+P3G2+P3P2G1+P3P2P1C0C_3 =G_3+P_3G_2+P_3P_2G_1+P_3P_2P_1C_0C3=G3+P3G2+P3P2G1+P3P2P1C0
C4=G4+P4G3+P4P3G2+P4P3P2G1+P4P3P2P1C0C_4 = G_4+ P_4G_3+P_4P_3G_2+P_4P_3P_2G_1+P_4P_3P_2P_1C_0C4=G4+P4G3+P4P3G2+P4P3P2G1+P4P3P2P1C04位快速加法器测试：
(3)16位的快速加法器设计
- 16位的快速加法器设计
(4)32位的快速加法器设计
- 32位的快速加法器电路图
- 32位的快速加法器测试图
三、ALU单元设计
(1)32位ALU单元设计
- 32位ALU单元设计图
- 32位ALU单元测试电路
- 32位ALU单元测试结果
四、阵列乘法器设计
(1)5位乘法与门阵列
- 5位乘法与门阵列电路图
- 5位阵列乘法器测试
(2)不带符号的5位阵列乘法器
- 不带符号的5位阵列乘法器电路图
- 不带符号的5位阵列乘法器测试
五、阵列除法器设计
(1)一位可控加减单元的电路设计
一位可控加减单元电路
一位可控加减单元测试
(2)4位阵列除法器设计
- 阵列除法器电路图
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