TMS320C6678上电配置和FPGA复位DSP
- 第一种是把DSP的配置管脚全部和FPGA的IO连接,由FPGA上电控制(文末附FPGA复位DSP程序)
- 第二种是通过外部上拉/下拉电阻。
- LRESET pin
- Watchdog timer、CORESEL[3:0] and RSTCFG register
- LPSC MMRs(memory-mapped registers)
module DSP_RST(input clk_25m,input RESETSTAT, //DSP复位状态 0表示复位态 1表示工作态input LOCKED, //时钟模块是否正常output ref LRESETNMIENz = 1'b0, //局部复位管脚output reg PORz=1'b0, //Power-on Resetoutput reg RESETFULL=1'b0, //Full Resetoutput reg RESET=1'b0 );reg [2:0] RES_STATE=2'b00;reg [15:0] por_counter=16'b0,resetfull_counter=16'b0,reset_counter=16'b0;parameter IDLE=2'b00,PULL_RESET=2'b01,PULL_POR=2'b10,PULL_RESETFULL=2'b11;always @(posedge clk_25m)if(LOCKED==1)begincase(RES_STATE)IDLE: RES_STATE<=PULL_RESET ;PULL_RESET: if(reset_counter<25000)beginreset_counter<=reset_counter+16'b1;RES_STATE<=RES_STATE;RESET<=1'b0;PORz<=1'b0;RESETFULL<=1'b0;endelsebeginRESET<=1'b1;LRESETNMIENz<=1`b1; //禁止局部复位。RES_STATE<=PULL_POR;endPULL_POR: if(por_counter<25000) beginpor_counter<=por_counter+16'b1;RES_STATE<=RES_STATE;PORz<=1'b0;endelsebeginPORz<=1'b1;RES_STATE<=PULL_RESETFULL;endPULL_RESETFULL:if(resetfull_counter<25000)beginresetfull_counter<=resetfull_counter+16'b1;RES_STATE<=RES_STATE;RESETFULL<=1'b0;endelsebeginRESETFULL<=1'b1;RES_STATE<=RES_STATE;endendcase endelsebeginreset_counter<=16'b0;resetfull_counter<=16'b0;por_counter<=16'b0;RES_STATE<=IDLE;RESET<=1'b0;PORz<=1'b0;RESETFULL<=1'b0;endendmodule`
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