杰理之高低速(HSB/LSB)时钟硬件模块【篇】
sys_clk: 系统时钟,可以在对应CPU目录下(如: cpu/wl82/tools )的 isd_config_rule.c 文件中 SYS_CLK=320MHz; 修改配置
sdram_clk: sdram时钟,当芯片不带sdram,则该时钟为0,可以在对应CPU目录下(如: cpu/wl82/tools )的 isd_config_rule.c 文件中 SDRAM_CL=3; 修改配置
hsb_clk: 高速时钟(系统时钟分频),可以在对应CPU目录下(如: cpu/wl82/tools )的 isd_config_rule.c 文件中 HSB_DIV=1; 修改配置
lsb_clk: 低速时钟(高速时钟分频),可以在对应CPU目录下(如: cpu/wl82/tools )的 isd_config_rule.c 文件中 LSB_DIV=2; 修改配置
sfc_clk: flash时钟(高速时钟分频,正常跑系统时从flash读取程序的时钟),可以在对应CPU目录下(如: cpu/wl82/tools )的 isd_config_rule.c 文件中 [SYS_CFG_PARAM] 的 #clk [0-255] 修改配置,如sfc_clk分频系数为2:SPI=2_1_0_0; sfc_clk分频系数为4:SPI=2_3_0_0;
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