[UVM]UVM环境中的clock agent方案
UVM环境中的clock agent方案
摘要:在验证环境中,我们通常需要多个不同频率的时钟,为了能方便的产生所需时钟,我们可以开发一个clk_agent,通过config来指定频率,通过interface传递。本文将给出一个clock agent的方案。
一、配置文件(clk_agent_cfg.sv)
typedef enum bit [3:0] {fs, ps, ns, us, ms, s, Hz, KHz, MHz, GHz, THz} clk_unit_e;class clk_cfg extends uvm_object;rand int unsigned phase_shift;rand int unsigned jitter_range;rand int unsigned duty_cycle;rand int unsigned clk_skew;rand int unsigned initial_value;real clk_period;real clk_high;real clk_low;real clk_period;clk_unit_e clk_unit_sel;function new(string name = "clk_cfg");super.new(name)endfunctionextern virtual function void gen_clk_hl_time();`uvm_onject_utils_begin
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