FPGA初学日常1：使用参数化设计实现模块的重用

#参数化
课程主要听的是b站小梅哥的课程，lesson5&6主要讲的是参数化的设计，在FPGA的模块内可以设置参数parameter = ？
第一种方法：
在调用该模块时可以使用

defparam modulename.paramname = ??

对模块内的参数进行重新赋值并不影响模块内原来的参数值，仅在该调用模块使用新定义的参数值。

第二种方法：
在调用该模块的上方单独将parameter作为参数例化调用，此时注意将模块名写在最上方，参数调用括号前写#，括号后不跟“；”

前几节课未做笔记，主要包括模块例化，调用，wire及reg型赋值
wire作为线性参数，在assign中赋值，不能再always语句块中赋值，reg未寄存器类型，不能在assign中赋值，只能在always中赋值。

移位操作 << 左移；

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第四节参数化设计实现模块的重用
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