DFT中常用英文缩写,词汇及详解(每日持续更新)
LVS
LVS的全称即是:Layout Versus Schematic。
LVS可以简称物理级别的formal
和功能类的一致性的比较formal相对而言,芯片里边的LVS可以视为物理版图(GDS)和原理图(Schematic)的已于比对规则文件(LVS)完成的一致性比较。版图(Layout)是指:工具(Calibre)对二进制文件(GDS)进行到spice网表的转化,原理图(Schematic)是指:工具(v2lvs)将verilog进行spice的网表转化,规则文件(RSF):是对GDS的操作,以及LVS比对是的常规配置
所以,用下表来对LVS和formal(LEC/formality)进行一个比较:
类目/工具 | Golden | Revised |
---|---|---|
formal RTL | RTL | syn-netlist |
formal gate | syn-netlist | layout-netlist |
LVS | layout-netlist | GDS |
可以看到,最终的用户会得到这样一个功能侧的恒等式
RTL = syn-netlsit = layout-nelist = GDS
最终的目标就是
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