1.set_logfile_handling:指定工具将转录信息定向到文件;输出log文件。
2.set_tsdb_output_directory:设置tsdb的输出目录,将需要的信息写入TSDB的目录中,以供后续步骤使用。
3.open_tsdb:使tsdb目录的内容对工具可见,可自动打开指定的tsdb目录。
4.set_tool_options:该命令设置Tessent Shell中的某些选项;-reapply_setting_after_reelaboration {on|off},当再次对当前设计使用set_current_design时,将重新阐述设计,当设置为“on”时,Tessent shell会保留某些设置,例如add_clocks、add_black_boxes等;-allow_vhdl_2008 on|off,如果任何模块中有2008(版本吧)的结构,为了加载2008版的package,则必须指定Tessent shell。
5.set_design_macros:指定一个或多个定义的宏供后续命令使用,就是宏定义,为了方便使用。
6.setenv:在工具环境中指定一个shell 环境变量;给环境变量赋一个新的值,仅是在当前tool的session中改变。
7.read_vhdl -format 2008 -f $f:读取一个或多个VHDL文件进入指定或默认logic library;-format 2008,可选,指定输入文件期望格式;-f,可选,tcl列表,指定指向要加载的design 文件的一个或多个ASCII文件的名称,调用的文件通常是由另一个工具生成,因此该选项以内需使用该文件,而不需要转换为read_vhdl命令所允许的格式。
8.read_verilog:读取一个或多个verlog文件进入指定或默认的logic library;-format,可选,指定输入Verilog文件的格式;-vcs_compatibility,可选,忽略synopsys编译所允许的语法错误。
9.read_cell_library:加载一个或多个cell library文件进入tools中。
10.read_design:在DFT插入之后重载入design,以执行分析或未来的DFT 插入过程;首先使用read_verilog和read_vhdl命令将设计读入工具中,在设计上,一旦执行DFT 插入过程之后,read_verilog和read_vhdl命令列表要求重新载入修改后的design进入工具中,被存储在design_name中;例如:使用read_verilog和read_vhdl命令读入RTL代码,然后进行DFT的Mbist插入,此时的RTL文件已经被修改,当一下步进行logic test插入时,则是使用read_design命令载入第一步修改后的RTL文件;-design_identifier,可选,被用来指定想要读入的design的design_in(每个design都对应一个design_id,用来代表这个design);–view full|graybox|interface,决定读入的design的视图,。
11.read_core_descriptions:读指定的TCD文件;TCD文件用于将扫描信息从一个level映射到下一个level,以便在更高级level运行ATPG,并为相关core的instances重新定位patterns。
12.read_icl:读ICL文件进入内部ICL dbs中。
13.set_current_design:为后续命令指定顶层设计,直到下一次该命令重置,就是为了指定顶层设计模块。
14.add_black_boxes:将verilog 模块或cell library的instances作为黑盒子,在黑盒子的输出或双向pins上设置约束值;存在一些block不需要做scan chain的,可以定义为black box;-Auto,将netlist或者cell library中不存在reference 模块的网表instances设置为黑盒。
15.set_design_level:指定当前设计的level。
16.set_system_mode:指定想要工具进入的操作状态。
17.create_port:在指定design模块上创建一个port。
18.intercept_connection:一个命令,使用get_dft_cell命令来获得指定功能名的cell,并且使用它来拦截到pin,port,或者net的连接。为了不连通吗? 不是不连通,是在原来的连接上加上相应的cell,例如Mux、AND、OR门等,使信号选择性连通。
19.get_instances:返回相对于当前design实例化的instances的集合,这些instance与指定的name_patterns列表相匹配,并接受指定选项的筛选;-silent,如果集合为空,不报错;-of_modules, 只返回指定的modules的instances。
20.create_connections:连接对象的pin,net,或者port。

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