电路设计中电阻电容电感的选择原则
- 为了防止存在于电源线中的交流噪声，每块IC片子的电源管脚都必须利用低感抗的电容器（0.1uF的陶瓷电容器通常就足够了）对地旁路。这些解耦电容器也有助于中和掉来自电源线和地线和非零电抗所形成的虚假反馈环路，这些环路可能会造成稳定性问题，为使这些措施更为有效，接线头一定要短以使分布电感最小，分布电感大约以1nH/mm速度增加，而电容器应装在尽量靠近运算放大器的管脚。一块精心组装的电路板在电源电压的入口点还应包括有10uF的极化电容器，以提供对电路旁路。另外，利用宽地线也会有助于保持一个电的绩效地的参考。
- 在低功率电路的设计中，最好的电阻值范围通常是1千欧到一兆欧之间。尽量避开用过高的电阻值（如10兆欧以上），因为周围的杂散电阻会降低你所用过高阻值电阻的有效值，特别是在有潮湿和浓盐度存在的环境中更是如此。另一方面，低电阻会引起不必要的高功率消耗。
- 纯粹能由电阻器、电感器、电容器构成滤波器（RLC滤波器），这些都是无源元件。然而，在反馈概念出现以后，在一个滤波器电路中吸收进一个放大器就有可能不用电感而实现任何响应。因为在这些基本电路元件中电感是最不理想的，况且体积笨重而且昂贵，不适合于IC型式的大规模生产。运算放大器的开环增益随频率而滚降，这个限制一般就将有源滤波器应用局限到赫以下范围。这包括了音频和仪器仪表的应用范围，在那里运算放大器滤波器获得了最为广泛的应用，而电感由于太笨重而无法与可利用的IC小型化相匹敌。超出运算放大器能达到的频率之上，电感还是占优势，所以高频滤波器还是用无源RLC元件实现的。在这些滤波器中，由于电感和电容值随工作频率范围上升而下降，所以电感的尺寸和重量更便于处置。
- TTL集成电路输入端悬空相当于逻辑高电平，与非门不使用的输入端可以悬空，但不允许带开路长线，以免引入干扰，产生逻辑错误；CMOS集成电路不用的输入端不能悬空，由于CMOS电路输入阻抗极高，易受外界影响造成逻辑混乱或损坏器件。
- 设计中常用贴片电阻和电容的封装及对应的功率：1210--1/2W，1206--1/4W，0805--1/8W，0603--1/10W，0402--1/16W
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