时序分析中的关键术语

2024-04-12 18:48:43

前言

在时序分析的相关文章中，我们常常看到很多关键术语，例如Launch edge， Latch edge， TCQ等，且时而存在不同的文章表达方式不一样的情况，例如Latch edge 与 Capture edge。其实，一旦了解一种术语的含义，就可以触类旁通，别人用其他方式表达，你也能明白他说什么，毕竟含义都是一样的。本文就针对时序分析中常用的术语，给予简单介绍。

正文

TCQ

TCQ，如下图示意：

以D触发器为例，它表示数据从被时钟C触发（输入时钟采样开始），到出现在输出引脚Q之间的时间；

Setup Time

Setup Time表示建立时间，这个我们都熟悉，它表示输入数据D，在时钟C触发之前必须保持稳定的时间，即距离时钟触发沿（上升沿或者是下降沿）之间数据稳定的时间。
如果数据在时钟触发之前的建立时间窗内（时钟沿之前的建立时间范围内）没有保持稳定，还在变化，则对该数据采样后得到的输出是不确定的。

Hold Time

Hold Time表示保持时间，它表示，输入数据D，在时钟C触发之后，保持稳定稳定的时间。
同理，如果数据在时钟触发沿之后的保持时间窗内没有保持稳定，而是变化了，那么输出也是不确定的。

Launch Edge

launch edge，即发起沿，即源触发器，或者发起触发器（Launch FF）的时钟有效沿，用于驱动数据，将数据发出。

Latch Edge

与Launch Edge同理，即捕获沿，或锁存沿，即锁存寄存器的时钟有效沿，用于捕获数据，将数据接收。

Setup Constraint

即为建立时间约束，它定义为设计中最慢的路径必须满足锁存触发器的建立时间；

Hold constraint

即为保持时间约束，它定义为设计中最快的路径必须满足锁存器的保持时间。

Timing Closure

时序收敛：如果一个设计同时满足了建立和保持约束，那么这个设计就被称为实现了时序收敛。静态时序分析将通过分析设计中的所有时序路径来证明/反驳设置和保持约束。

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