EDA技术实用教程 | 复习八 | 多位加法器的行为级描述
多位加法器的设计
8位加法器的时序仿真图如图3-9所示
A为加数,B为被加数,CIN为进位输入,DOUT为和,COUT为进位输出。
module ADDER8b(A, B, CIN, COUT, DOUT);input [7 : 0] A, B;input CIN;output COUT;output [7 : 0] DOUT;//加操作的进位进入并位COUTassign {COUT, DOUT} = A + B + CIN;
endmodule
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