将一个D触发器转换成JK触发器

第一次发博客，单纯想记录下自己实验的历程，能给后面有困难的同学带来帮助更好！

本篇是关于数字电路的实验：如何将一个D触发器转换成JK触发器并进行验证的过程，话不多说，开始正文：

一、实验原理：

我们知道D触发器的逻辑功能为 $D=Q_{n+1}$ ，JK触发器的逻辑功能为 $Q_{n+1}=J\overline{Q_{n}}+\overline{K}Q_{n}$ 。

要想转换，就需要用与门和非门，构造出以下的逻辑关系 $D=J\overline{Q_{n}}+\overline{K}Q_{n}$ 。

因为D触发器为上边沿触发，JK触发器为下边沿触发，所以我在时钟信号上加了一个非门（这里是我自己觉得会比较好，有同学说是不用加的，没弄太清楚，希望大佬指正）

二、实验器材：

电源等器材不列举，这里只列举各种芯片：

D触发器（7474），与门（7408），非门（7404），或门（7432）

三、实验电路图：

五、测试转换后的JK触发器功能

这里只测试了改造后的JK触发器工作时的值是否正确，也就是R=S=1时的结果进行了测试，CH1为Qn的输出信号，CH2为时钟信号

J=0K=O时

J=0K=1时

J=1K=0时

J=1K=1时

c.实验数据记录，讨论实验结果

J	K	触发变沿	JK触发器Qn值	改造的得到电路Qn值
0	0	无	Qn	Qn
0	1	无	1	1
1	0	无	0	0
1	1	下边沿	$\overline{Q_{n}}$	$\overline{Q_{n}}$

在J=K=1时，我们能看到CH1中的信号Qn在CH2信号的下降沿处发生了反转。

测试符合预期，得到的D触发器改造的JK触发器符合要求。

PS:这里提及下自己在实验过程中出现的问题：在逻辑分析仪采样的时候，采样率不要过高，同时时钟信号的频率应该大一点，才能看到完整的信号，这里我取到的频率为1kHz的时钟信号和4K的逻辑分析仪的采样率。

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