基于VC709开发板的光纤收发的调试与实现，以及过程中遇到的问题与解决。
VC709是xilinx旗下的一款开发板，搭载了强大的Virtex-7芯片。有着丰富存储资源，时钟资源与高速接口。具体可参考xilinx官网的ug887手册，本次主要是想记录一下自己的学习过程与遇到的困难。
一、利用IBERT核实现回环测试。
具体的实现流程可参考知乎文章：在开始高速接口前，我们来试试IBERT测试吧！ - 知乎
下面讲讲自己遇到的困难与最终解决方案。
这里设置的设置没什么好说的，注意一点就是，参考时钟决定了你的线速度，因为板子上的参考时钟是固定的（也可以通过外时钟的接入或者可编程时钟进行调改），线速度在1.25~6.25之间选择CPLL，大于6.25勾选QPLL。
笔者本次选择利用SFP+接口来做回环测试，一开始没有合适的外部时钟源，于是想用可编程SI5324来产生时钟，SI5324生成时钟的原理就是配置其中相关的寄存器，当时老板想让我用HLSc++来实现，通过已AXI总线接口的方式来向SI5432配置数据，在利用VIVADO自带的AXI转IIC的IP核来实现，但是自己选择了使用MicroBlaze软核的方式来实现（还有一种PICOBlaze的软核实现方式，两者都可以）。
通过FPGA构建电路，再利用SDK开发工具写C++语言，完成配置。利用示波器观测如下
完成了时钟配置以后，再将IBERT的bit烧进FPGA，出现警告，提示没有时钟。按道理来说，si5324芯片属于外部芯片，再次烧写bit流应该不会干扰到时钟的产生。百度知道有可能是烧写bit引起了si5324芯片的复位，于是改用了另外一种方案。
VC709上有丰富的时钟资源，其中就有USER_CLOCK，此时钟上电就会产生156.25Mhz，那么能不能将这个时钟连接到外时钟上呢？ 显然是可以的。不过要在原有的example的代码上加点东西。
如图声明板子上的两个时钟
但是光申明两个时钟也无法将两个时钟连接在一起，还需要这样一段源语，才能将156.25Mhz引出来。
将SMA_USER_CLOCK和SMA_SFP_CLOCK对接。
最后成功。
信号的效果并不好，后期再找时间找找原因，调一调。
二、SFP具体收发的实现。
要实现光纤通信一定要了解GT系列的工作机制，具体可以参考UG476手册，想也可以参考以下博文：GTX_IP核实现SMA口发送数据（4）GTX具体各个模块原理详细介绍 - 快乐气氛组阿宇 - 博客园
沧小海深入剖析xilinx的GTP/GTX核，掌握高速串行收发机制——第五章 GTP发送模块详解_滄海的博客-CSDN博客
这两个博主讲个很详细。
具体实现打开 7 SERIES FPGA TRANSCEIVERS WIZARD,配置好相关参数（一定要看手册或者相关资料），打开example。此时想要直接运行是行不通的，需要加一点和修改一点东西。
首先就是参考时钟的配置，还是沿用我们配置ibert参考时钟办法，加好相关代码及其约束，还有就是对TRACK_DATA_OUT的管脚约束，如下。
还有对DRP_CLK_IN_P的约束（如果不约束布线就会报错）
将时钟及其管脚搞定以后还有些小问题需要解决。
打开我们的源代码，要将此处原来的TURE改为FALSE，TURE的话指的是仿真模式。还有下面的SIM_QPLLREFCLK_SEL要改为3‘b010，因为我们选的是外部时钟，如果是SI5324产生的时钟就用001.
下面的这个QPLLREFCLKSEL也改为3’b010。
一切改好后，终于实现了我们想要的收发结果啦！
数是已经实现了，还要看看信号的质量如何，这个等后面在进行调试。
三、xilinx官方代码的深度剖析（怕自己忘记了）。
GTX_IP核实现SMA口发送数据（3）GTX例程代码详细介绍 - 快乐气氛组阿宇 - 博客园
先把学习网址玛住，后面有时间了，再来提炼
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