PIC18F47Q10 Curiosity Nano 基本介绍(未完待续~)
1. 套件简介
PCI18F47Q10 Curiosity Nano
评估套件是一个单片机硬件平台,用于评估 PIC18-Q10
家族中的微控制器。该板搭载了 PIC18F47Q10
微控制器 (MCU
)。
该板由 MPLAB X IDE
支持,使用该软件可轻松访问 PIC18F47Q10
的功能,以此来探索如何将此设备集成到自主化的设计中。
Curiosity Nano
系列评估板包括一个板载调试器。无需外部工具即可烧写和调试。
相关链接:
MPLAB X IDE:用于连接、配置、开发和调试 Microchip
微控制器的软件。
Code examples on GitHub:一些代码示例。
PIC18F47Q10 网址:可以在此找到芯片相关的数据手册等相关文档。
PIC18F47Q10 Curiosity Nano 网址:可以在此找到该套件的相关信息以及指导手册等资源。
2. PIC18F47Q10 简介
PIC18F47Q10
微控制器具有模拟、内核独立和通信外设,适用于广泛通用和低功耗应用的范围。 该控制器具有 40pin
脚并配备了 10
位 ADC
使用计算 (ADC2
) 自动电容分压器 (CVD
) 技术实现高级触摸感应,平均、过滤、过采样和执行自动阈值比较。还提供了一套核心独立外设,例如互补波形发生器 (CWG
)、窗口看门狗定时器(WWDT
)、循环冗余校验 (CRC
)/内存扫描、过零检测 (ZCD
)、可配置逻辑单元(CLC
)、和外设引脚选择 (PPS
),提供更高的设计灵活性和更低的系统成本。
Device | Program Memory Flash(bytes) | Data SRAM(bytes)(2) | Data EEPROM(bytes) | I/O Pins | 16-bit Timers | Comparators | 10-bit ADC2 with Computation (ch) | 5-bit DAC | Zero-Cross Detect | CCP/10-bit PWM | CWG | CLC | Low Voltage Detect (LVD) | 8-bit TMR with HLT | Windowed Watchdog Timer | CRC with Memory Scan | EUSART | I2c/SPI | pps | Peripheral Module Disable | Temperature Indicator | Debug(1) |
---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
PIC18F47Q10 | 128k | 3615 | 1024 | 36 | 4 | 2 | 35 | 1 | 1 | 2/2 | 1 | 8 | 1 | 3 | Y | Y | 2 | 2 | Y | Y | Y | I |
[注1]:Debugging Methods: (I) - Integrated on-chip(片上集成);
[注2]:SRAM 包含 256 字节的 SECTOR 空间,该空间不包括在 MPLAB® X 显示的数据大小中。
PIC18F47Q10
拥有 40
个引脚采用 QFN
(Quad Flat No-leads Package
) 封装(方形扁平无引脚封装)
3. PIC18F47Q10 引脚分配
引脚分配表:
I/O(2) | 40-pin QFN | A/D | Reference | Comparator | Timers | CCP | CWG | ZCD | Interrupt | EUSART | DSM | MSSP | Pull-up | Basic |
---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
RA0 | 17 | ANA0 | — | C1INO-C2IN0- | — | — | — | — | IOCA0 | — | — | — | Y | — |
RA1 | 18 | ANA1 | — | C1IN1-C2IN1- | — | — | — | — | IOCA1 | — | — | — | Y | — |
RA2 | 19 | ANA2 | DAC1OUT1 VREF-(DAC5) VREF-(ADC) | C1IN0+ C2IN0+ | — | — | — | — | IOCA2 | — | — | — | Y | — |
RA3 | 20 | ANA3 | VREF+ (DAC5) VREF+ (ADC) | C1IN1+ | — | — | — | — | IOCA3 | — | MDCARL(1) | — | Y | — |
RA4 | 21 | ANA4 | — | — | T0CKI(1) | — | — | — | IOCA4 | — | MDCARH(1) | — | Y | — |
RA5 | 22 | ANA5 | — | — | — | — | — | — | IOCA5 | — | MDSRC(1) | SS1(1) | Y | — |
RA6 | 29 | ANA6 | — | — | — | — | — | — | IOCA6 | — | — | — | Y | CLKOUT |
RA7 | 28 | ANA7 | — | — | — | — | — | — | IOCA7 | — | — | — | Y | OSC1 |
RB0 | 8 | ANB0 | — | C2IN1+ | — | — | CWG1(1) | ZCDIN | IOCB0 INT0(1) | — | — | SS2(1) | Y | — |
RB1 | 9 | ANB1 | — | C1IN3- C2IN3- | — | — | — | — | IOCB1 INT1(1) | — | — | SCK2(1) SCL2(3,4) | Y | — |
RB2 | 10 | ANB2 | — | — | — | — | — | — | IOCB2 INT2(1) | — | — | SDI2(1) SDA2(3,4) | Y | — |
RB3 | 11 | ANB3 | — | C1IN2- C2IN2- | — | — | — | — | IOCB3 | — | — | — | Y | — |
RB4 | 12 | ANB4 | — | — | T5G(1) | — | — | — | IOCB4 | — | — | — | Y | — |
RB5 | 13 | ANB5 | — | — | T1G(1) | — | — | — | IOCB5 | — | — | — | Y | — |
RB6 | 14 | ANB6 | — | — | — | — | — | — | IOCB6 | CK2(1,3) | — | — | Y | ICSPCLK |
RB7 | 15 | ANB7 | DAC1OUT2 | — | T6IN(1) | — | — | — | IOCB7 | RX2/DT2(1,3) | — | — | Y | ICSPDAT |
RC0 | 30 | ANC0 | — | — | T1CKI(1) T3CKI(1) T3G(1) | — | — | — | IOCC0 | — | — | — | Y | SOSCO |
RC1 | 31 | ANC1 | — | — | — | CCP2(1) | — | — | IOCC1 | — | — | — | Y | SOSCIN SOSCI |
RC2 | 32 | ANC2 | — | — | T5CKI(1) | CCP1(1) | — | — | IOCC2 | — | — | — | Y | — |
RC3 | 33 | ANC3 | — | — | T2IN(1) | — | — | — | IOCC3 | — | — | SCK1(1) SCL1(3,4) | Y | — |
RC4 | 38 | ANC4 | — | — | — | — | — | — | IOCC4 | — | — | SDI1(1) SDA1(3,4) | Y | — |
RC5 | 39 | ANC5 | — | — | T4IN(1) | — | — | — | IOCC5 | — | — | — | Y | — |
RC6 | 40 | ANC6 | — | — | — | — | — | — | IOCC6 | CK1(1,3) | — | — | Y | — |
RC7 | 1 | ANC7 | — | — | — | — | — | — | IOCC7 | RX1/DT1(1,3) | — | — | Y | — |
RD0 | 34 | AND0 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD1 | 35 | AND1 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD2 | 36 | AND2 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD3 | 37 | AND3 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD4 | 2 | AND4 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD5 | 3 | AND5 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD6 | 4 | AND6 | — | — | — | — | — | — | — | — | — | — | Y | — |
RD7 | 5 | AND7 | — | — | — | — | — | — | — | — | — | — | Y | — |
RE0 | 23 | ANE0 | — | — | — | — | — | — | — | — | — | — | Y | — |
RE1 | 24 | ANE1 | — | — | — | — | — | — | — | — | — | — | Y | — |
RE2 | 25 | ANE2 | — | — | — | — | — | — | — | — | — | — | Y | — |
RE3 | 16 | — | — | — | — | — | — | — | IOCE3 | — | — | — | Y | Vpp/MCLR |
VSS | 6 | — | — | — | — | — | — | — | — | — | — | — | — | VSS |
VDD(5) | 7 | — | — | — | — | — | — | — | — | — | — | — | — | VDD |
VDD(5) | 26 | — | — | — | — | — | — | — | — | — | — | — | — | VSS |
VSS | 27 | — | — | — | — | — | — | — | — | — | — | — | — | VSS |
OUT(2) | — | ADGRDA ADGRDB | — | C1OUT C2OUT | TMR0 | CCP1 CCP2 PWM3 PWM4 | CWG1A CWG1B CWG1C CWG1D | — | — | TX1/CK1(3) DT1(3) TX2/CK2(3) DT2(3) | DSM | SDO1 SCK1 SDO2 SCK2 | — | — |
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